如何将AD或PADS的原理图导入Allegro做Layout
作为allegro专业layout的我们，由于设计软件的限制，有时候客户提供的原理图可能是ad或power logic绘制的，而ad或power logic的原理图转成orcad原理图后可能存在丢失网络或器件的风险，无法直接用来输出网表导入allegro设计。 如果对转换后的原理图进行修正得整个原理图从头到尾彻底检查一遍，这个工作量以及存在的风险对于我们layout工程师和硬件工程师来说可能都不太现实。 如果能将ad或power logic原理图产生的网表转成allegro格式的网表，那就能导入allegro里面设计了，就不需要转换原理图了，省事又省时，这是最为简单方便又靠谱的方法了。
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allegro网表的调法有两种：
一种是第一方网表；
另一种是第三方网表。
第一方网表需要通过orcad capture来产生，也是绝大部分人使用的导入方法。 第三方网表可以通过各种原理图设计软件来产生（如protel、ad、power logic、dxdesigner、eagle等）。 第一方网表的调入比较严谨，要求原理图与pcb封装必须完全一一对应，其网表格式也相对复杂。 但是第三方网表的调入就相对没那么严谨，封装的器件管脚只要不比原理图器件管脚少就可以了，器件管脚数量可以不需要一样多，其网表格式相对比较简单有规律性。 因此，我们可以通过将ad或power logic原理图产生的网表内容转换成符合allegro第三方网表的格式，然后导入allegro即可！
allegro第三方网表封装定义的标准格式 其中，感叹号和分号是分隔符，value可有可无，给value添加单引号可屏蔽value值里面的一些非法字符，如下图所示：
另一种格式的第三方网表 1、输出网表：a. protel或ad原理图输出的网表可以有两种选择：protel或telesis。
b. power logic原理图输出网表：
2、将ad或power logic输出的网表转换成allegro格式的第三方网表：使用附件里面的“网表转换.exe”工具将对应格式的网表转成allegro格式的第三方网表。
注意：“网表转换.exe”工具如果对应网表的格式选择不对，转换出来的网表文件里面的内容是空的。该程序protel转allegro网表会将器件的value值带入，而pads转allegro网表器件的value值是不会带入的。
如果是telesis格式的网表，由于该程序里面没有telesis格式的网表转allegro第三方网表，我们可以到以下载一个skill加载使用即可。
注意：文末有下载方式，文章“protel格式网表转换allegro格式网表的skill程序”是一个对skill程序的讲解。
3、allegro的第三方网表调入与第一方网表调入不同，第三方网表调入还需要器件的device才行。因此我们还需要生成器件的device文件，也就是后缀为txt的封装文件，加载附件里面的skill文件“auto_create_device.il”，然后随便打开封装库里面的任意一个dra文件，在命令栏里面输入命令“create_device_batch”即可将当前目录下的所有dra自动生成psm，pad和txt文件；
skill的加载方法：
将附件里面的“auto_create_device.il.il”放到cadencespb_16.6sharelocalpcbskill目录下，用记事本打开cadencespb_16.6sharelocalpcbskill目录下的allegro.ilinit文件，（如果没有这个文件就自己新建一个txt文本文档，然后将文件名称和后缀修改为allegro.ilinit即可），在里面独立一行添加一行代码：load(auto_create_device.il.il)，然后保存文件，再重启软件即可！
4、指定库路径：将下图的三个库路径指定到封装库路径下。
5、导入转换后的第三方网表：按照下图选择转换后的网表文件，并按下图勾选对应的选项，然后导入即可。 如有报错则根据当前目录下生成的netin.log报表查找关键词“error”，并根据error提示解决问题即可。
与第一方网表调入相比，第三方网表调入报错的问题都比较清晰易懂，不难解决，以下是第三方网表调入报错的一些常见问题类型和解决方法：a. 原理图封装名称中带有非法字符（如小数点、空格、@、#、￥、%、&、*、（、)、+等）。
解决方法：根据提示的位号和封装名称将原理图上对应器件的封装名称中的非法字符统一修改为下滑杠。b. 所有封装都有了，但是导入还是报错：没有指定库路径。
解决方法：导入前先将devpath、padpath和psmpath三个库路径设置到封装库所在的目录，再导入网表。c. 所有封装都有了，库路径也指定了，但导入也还报错：器件的封装没有生成device文件。解决方法：先将封装库生成device文件后再导入。d. 库路径里面带有非法字符，软件无法识别库路径。解决方法：将文件目录里面的非法字符改掉。e. pcb封装名称中带有非法字符，造成pcb封装名称与原理图器件封装名称对不上。解决方法：将pcb封装名称修改为原理图器件封装的名称，与之对应。
注意：c、d、e的报错类型提示跟b是一样的。
f. pcb封装的pin number与原理图器件的pin number不匹配（原理图三极管使用的pin number是：gsd ，而pcb封装是：123）。
解决方法：修改原理图或pcb封装，使其pin number对应即可。g. pcb封装的pin管脚比原理图的少（如下图原理图多了13和14两个固定脚，而pcb封装则没有）。
解决方法：检查对应的封装管脚，如少了则给pcb封装加上。h. 原理图网络名称带有空格。
解决方法：将原理图上带有空格的网络名称中的空格去掉或修改为下滑杆。 以上为常见的第三方网表导入报错问题，可以根据问题报错提示进行排查。 另外，有时候由于ad或pads原理图封装命名的不规范性造成网表里面带有大量非法字符，修改原理图太麻烦的话可以转换网表后在第三方网表里面进行字符替换。 然后保存后再导入，不过这样每次更新网表都得这样替换一次，比较麻烦，建议有时间最好修改下原理图与pcb对应比较好，这样后续更新网表就可以转换后直接导入了，而不需要每一次都要替换非法字符。
注意：第三方网表调入与第一方网表调入的区别：
1、第三方网表导入是需要器件的device文件的，如果没有device文件是导入不了的，库路径里面的devpath也必须指定。
2、必须先解决所有的报错问题才能成功导入；
3、第三方网表调入的pcb是不支持与orcad原理图直接交互的；
4、文件名称和路径中不要使用非法字符。allegro中所说的非法字符就是除了数字、字母、中杆和下滑杆以外的其它所有字符，包括空格。
allegro有些操作是不支持非法字符的，乱用非法字符有时候就是这么一个不起眼的坏习惯都能折腾你半天时间还找不到问题所在，养成良好的设计习惯能让你少走弯路。
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allegro网表的调法有两种：
一种是第一方网表；
另一种是第三方网表。
第一方网表需要通过orcad capture来产生，也是绝大部分人使用的导入方法。 第三方网表可以通过各种原理图设计软件来产生（如protel、ad、power logic、dxdesigner、eagle等）。 第一方网表的调入比较严谨，要求原理图与pcb封装必须完全一一对应，其网表格式也相对复杂。 但是第三方网表的调入就相对没那么严谨，封装的器件管脚只要不比原理图器件管脚少就可以了，器件管脚数量可以不需要一样多，其网表格式相对比较简单有规律性。 因此，我们可以通过将ad或power logic原理图产生的网表内容转换成符合allegro第三方网表的格式，然后导入allegro即可！
allegro第三方网表封装定义的标准格式 其中，感叹号和分号是分隔符，value可有可无，给value添加单引号可屏蔽value值里面的一些非法字符，如下图所示：
另一种格式的第三方网表 1、输出网表：a. protel或ad原理图输出的网表可以有两种选择：protel或telesis。
b. power logic原理图输出网表：
2、将ad或power logic输出的网表转换成allegro格式的第三方网表：使用附件里面的“网表转换.exe”工具将对应格式的网表转成allegro格式的第三方网表。
注意：“网表转换.exe”工具如果对应网表的格式选择不对，转换出来的网表文件里面的内容是空的。该程序protel转allegro网表会将器件的value值带入，而pads转allegro网表器件的value值是不会带入的。
如果是telesis格式的网表，由于该程序里面没有telesis格式的网表转allegro第三方网表，我们可以到以下载一个skill加载使用即可。
注意：文末有下载方式，文章“protel格式网表转换allegro格式网表的skill程序”是一个对skill程序的讲解。
3、allegro的第三方网表调入与第一方网表调入不同，第三方网表调入还需要器件的device才行。因此我们还需要生成器件的device文件，也就是后缀为txt的封装文件，加载附件里面的skill文件“auto_create_device.il”，然后随便打开封装库里面的任意一个dra文件，在命令栏里面输入命令“create_device_batch”即可将当前目录下的所有dra自动生成psm，pad和txt文件；
skill的加载方法：
将附件里面的“auto_create_device.il.il”放到cadencespb_16.6sharelocalpcbskill目录下，用记事本打开cadencespb_16.6sharelocalpcbskill目录下的allegro.ilinit文件，（如果没有这个文件就自己新建一个txt文本文档，然后将文件名称和后缀修改为allegro.ilinit即可），在里面独立一行添加一行代码：load(auto_create_device.il.il)，然后保存文件，再重启软件即可！
4、指定库路径：将下图的三个库路径指定到封装库路径下。
5、导入转换后的第三方网表：按照下图选择转换后的网表文件，并按下图勾选对应的选项，然后导入即可。 如有报错则根据当前目录下生成的netin.log报表查找关键词“error”，并根据error提示解决问题即可。
与第一方网表调入相比，第三方网表调入报错的问题都比较清晰易懂，不难解决，以下是第三方网表调入报错的一些常见问题类型和解决方法：a. 原理图封装名称中带有非法字符（如小数点、空格、@、#、￥、%、&、*、（、)、+等）。
解决方法：根据提示的位号和封装名称将原理图上对应器件的封装名称中的非法字符统一修改为下滑杠。b. 所有封装都有了，但是导入还是报错：没有指定库路径。
解决方法：导入前先将devpath、padpath和psmpath三个库路径设置到封装库所在的目录，再导入网表。c. 所有封装都有了，库路径也指定了，但导入也还报错：器件的封装没有生成device文件。解决方法：先将封装库生成device文件后再导入。d. 库路径里面带有非法字符，软件无法识别库路径。解决方法：将文件目录里面的非法字符改掉。e. pcb封装名称中带有非法字符，造成pcb封装名称与原理图器件封装名称对不上。解决方法：将pcb封装名称修改为原理图器件封装的名称，与之对应。
注意：c、d、e的报错类型提示跟b是一样的。
f. pcb封装的pin number与原理图器件的pin number不匹配（原理图三极管使用的pin number是：gsd ，而pcb封装是：123）。
解决方法：修改原理图或pcb封装，使其pin number对应即可。g. pcb封装的pin管脚比原理图的少（如下图原理图多了13和14两个固定脚，而pcb封装则没有）。
解决方法：检查对应的封装管脚，如少了则给pcb封装加上。h. 原理图网络名称带有空格。
解决方法：将原理图上带有空格的网络名称中的空格去掉或修改为下滑杆。 以上为常见的第三方网表导入报错问题，可以根据问题报错提示进行排查。 另外，有时候由于ad或pads原理图封装命名的不规范性造成网表里面带有大量非法字符，修改原理图太麻烦的话可以转换网表后在第三方网表里面进行字符替换。 然后保存后再导入，不过这样每次更新网表都得这样替换一次，比较麻烦，建议有时间最好修改下原理图与pcb对应比较好，这样后续更新网表就可以转换后直接导入了，而不需要每一次都要替换非法字符。
注意：第三方网表调入与第一方网表调入的区别：
1、第三方网表导入是需要器件的device文件的，如果没有device文件是导入不了的，库路径里面的devpath也必须指定。
2、必须先解决所有的报错问题才能成功导入；
3、第三方网表调入的pcb是不支持与orcad原理图直接交互的；
4、文件名称和路径中不要使用非法字符。allegro中所说的非法字符就是除了数字、字母、中杆和下滑杆以外的其它所有字符，包括空格。
allegro有些操作是不支持非法字符的，乱用非法字符有时候就是这么一个不起眼的坏习惯都能折腾你半天时间还找不到问题所在，养成良好的设计习惯能让你少走弯路。
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