全加器,全加器是什么意思
全加器,全加器是什么意思
full-adder
用门电路实现两个二进数相加并求出和的组合线路，称为一个全加器。
一位全加器全加器是能够计算低位进位的二进制加法电路
一位全加器(fa)的逻辑表达式为：
s＝a⊕b⊕cin
co＝ab＋bcin＋acin
其中a,b为要相加的数，cin为进位输入；s为和，co是进位输出；
如果要实现多位加法可以进行级联，就是串起来使用；比如32位+32位，就需要32个全加器；这种级联就是串行结构速度慢，如果要并行快速相加可以用超前进位加法，
超前进位加法前查阅相关资料；
如果将全加器的输入置换成a和b的组合函数xi和y（s0…s3控制）,然后再将x,y和进位数通过全加器进行全加，就是alu的逻辑结构结构。
即 x＝f（a，b)
y＝f（a，b）
不同的控制参数可以得到不同的组合函数,因而能够实现多种算术运算和逻辑运算。
半加器、全加器、数据选择器及数据分配器
一、实验目的
1.验证半加器、全加器、数据选择器、数据分配器的逻辑功能。
2.学习半加器、全加器、数据选择器的使用。
3.用与非门、非门设计半加器、全加器。
4.掌握数据选择器、数据分配器扩展方法。
二、实验原理
1.半加器和全加器
根据组合电路设计方法,列出半加器的真值表,见表7。逻辑表达式为：
s =ab + ab= a⊕b
c = ab
半加器的逻辑电路图如图17所示。
用两个半加器可组成全加器,原理图如图18所示。
在实验过程中,我们可以选异或门74ls86及与门74ls08来实现半加器的逻辑功能；也可用全与非门如74ls00、反相器74ls04组成半加器。这里全加器不用门电路构成,而选用集成的双全加器74ls183。其管脚排列和逻辑功能表分别见图19和表4.9所示
（a）用异或门组成的半加器（b）用与非门组成的半加器
图17 半加器逻辑电路图
图18 由二个半加器组成的全加器
图19 74ls183双全加器管脚排列图
2.数据选择器和数据分配器
数据选择器又叫多路开关,其基本功能相当于单刀多位开关,其集成电路有“四选一”、“八选一”、“十六选一”等多种类型。这里我们以“八选一”数据选择器74ls151为例进行实验论证。
数据分配器,实际上其逻辑功能与数据选择器相反。它的功能是使数据由1个输入端向多个输出端中的某个进行传送,它的电路结构类似于译码器。所不同的是多了一个输入端。若选择器输入端恒为1,它就成了上一实验的译码器。实际上,我们可以用译码器集成产品充当数据分配器。例如,用2-4线译码器充当四路数据分配器,3–8线译码器充当八路数据分配器。就是将译码器的译码输出充当数据分配器输出,而将译码器的使能输入充当数据分配器的数据输入。
三、实验内容与步骤
1.半加器、全加器
（1）根据组合电路设计方法,列出半加器的逻辑功能表,见表7。由异或门74ls86和与门74ls08组成半加器,半加器的实验电路图如图20所示。74ls86的管脚排列图见图21所示（74ls08管脚排列图见门电路实验的图2）。
将74ls86、74ls08集成片插入ic空插座中,按实验电路图20接线,进行半加器逻辑功能验证。
实验时输入端a、b接输入信号,输出端s、c接发光二极管led,观察和数与进位数,并记录。
（2）全加器逻辑功能验证：本实验中全加器不用门电路构成,而选用集成的双全加器74ls183。将74ls183集成片插入ic空插座中验证其逻辑功能与表8中结果进行比较。
图20 用异或门组成的半加器实验电路图
图21 74ls86管脚排列图
表7 半加器逻辑功能表
输 入
和
进 位
a b
s
c
0 0
0 1
1 0
1 1
0
1
1
0
0
0
0
1
表8 全加器逻辑功能表
输 入
输 出
ci-1 b a
si ci
0 0 0
0 0 1
0 1 0
0 1 1
1 0 0
1 0 1
1 1 0
1 1 1
0 0
1 0
1 0
0 1
1 0
0 1
0 1
1 1
将全加器74ls183集成片插入ic空插座,输入端a、b、ci-1分别接逻辑开关k1、k2、k3,输出si和ci接发光二极管led。按全加器逻辑功能表输入逻辑电平信号,观察输出si及进位ci并记录下来。
2.数据选择器和数据分配器
（1）数据选择器
将74ls151“八选一”数据选择器插入ic空插座中（管脚排列图如图22所示）,按图23接线。其中c、b、a为三位地址码,s为低电平选通输入端,d0~d7为数据输入端,输出y为原码输出端,w为反码输出端。置选通端s为0电平（即低电平）,数据选择器被选中,拨动逻辑开关k3~k1分别为000,001，…111（置数据输入端d0~d7分别为10101010或11110000）,观察输出端y和w输出结果,并记录。
图22 74ls151管脚排列图
图23 八选一数据选择器实验接线图
（2）数据分配器,其逻辑功能与数据选择器相反，常常用译码器集成片充当数据分配器。在多路分配器中用3线-8线74ls138译码器接成数据分配器形式,从而完成多路信号的传输。具体实验接线见图24。
图24 多路信号传输实验接线图（多路分配器）
将74ls138集成片插入ic空插座中（管脚排列图见“编码器”图4.27）,按图4.46接线。d0~d7分别接数据开关或逻辑开关,d'0~d'7接8个发光二极管led显示输出,数据选择器和数据分配器的地址码一一对应相连,并接三位逻辑电平开关（也可用8421码拨码开关的4、2、1三位或三位二进制计数器的输出端qc、qb、qa）。把数据选择器74ls151原码输出端y与74ls138的g2a和g2b输入端相连,二个集成片的通选分别接规定的电平。这样即完成了多路分配器的功能验证。
置d0~d7为11110000和10101010两种状态,再分别两次置地址码a3~a0为0~7,观察输出发光二极管led的状态,并记录。
四、实验总结
1.整理实验数据和实验线路图。
2.试用数据选择器实现全加器及比较器功能,画出具体线路图。
五、注意事项
所有实验用集成片在实验时都必须接“+5v”电源和接地。
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一位全加器全加器是能够计算低位进位的二进制加法电路
一位全加器(fa)的逻辑表达式为：
s＝a⊕b⊕cin
co＝ab＋bcin＋acin
其中a,b为要相加的数，cin为进位输入；s为和，co是进位输出；
如果要实现多位加法可以进行级联，就是串起来使用；比如32位+32位，就需要32个全加器；这种级联就是串行结构速度慢，如果要并行快速相加可以用超前进位加法，
超前进位加法前查阅相关资料；
如果将全加器的输入置换成a和b的组合函数xi和y（s0…s3控制）,然后再将x,y和进位数通过全加器进行全加，就是alu的逻辑结构结构。
即 x＝f（a，b)
y＝f（a，b）
不同的控制参数可以得到不同的组合函数,因而能够实现多种算术运算和逻辑运算。
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一、实验目的
1.验证半加器、全加器、数据选择器、数据分配器的逻辑功能。
2.学习半加器、全加器、数据选择器的使用。
3.用与非门、非门设计半加器、全加器。
4.掌握数据选择器、数据分配器扩展方法。
二、实验原理
1.半加器和全加器
根据组合电路设计方法,列出半加器的真值表,见表7。逻辑表达式为：
s =ab + ab= a⊕b
c = ab
半加器的逻辑电路图如图17所示。
用两个半加器可组成全加器,原理图如图18所示。
在实验过程中,我们可以选异或门74ls86及与门74ls08来实现半加器的逻辑功能；也可用全与非门如74ls00、反相器74ls04组成半加器。这里全加器不用门电路构成,而选用集成的双全加器74ls183。其管脚排列和逻辑功能表分别见图19和表4.9所示
（a）用异或门组成的半加器（b）用与非门组成的半加器
图17 半加器逻辑电路图
图18 由二个半加器组成的全加器
图19 74ls183双全加器管脚排列图
2.数据选择器和数据分配器
数据选择器又叫多路开关,其基本功能相当于单刀多位开关,其集成电路有“四选一”、“八选一”、“十六选一”等多种类型。这里我们以“八选一”数据选择器74ls151为例进行实验论证。
数据分配器,实际上其逻辑功能与数据选择器相反。它的功能是使数据由1个输入端向多个输出端中的某个进行传送,它的电路结构类似于译码器。所不同的是多了一个输入端。若选择器输入端恒为1,它就成了上一实验的译码器。实际上,我们可以用译码器集成产品充当数据分配器。例如,用2-4线译码器充当四路数据分配器,3–8线译码器充当八路数据分配器。就是将译码器的译码输出充当数据分配器输出,而将译码器的使能输入充当数据分配器的数据输入。
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1.半加器、全加器
（1）根据组合电路设计方法,列出半加器的逻辑功能表,见表7。由异或门74ls86和与门74ls08组成半加器,半加器的实验电路图如图20所示。74ls86的管脚排列图见图21所示（74ls08管脚排列图见门电路实验的图2）。
将74ls86、74ls08集成片插入ic空插座中,按实验电路图20接线,进行半加器逻辑功能验证。
实验时输入端a、b接输入信号,输出端s、c接发光二极管led,观察和数与进位数,并记录。
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图20 用异或门组成的半加器实验电路图
图21 74ls86管脚排列图
表7 半加器逻辑功能表
输 入
和
进 位
a b
s
c
0 0
0 1
1 0
1 1
0
1
1
0
0
0
0
1
表8 全加器逻辑功能表
输 入
输 出
ci-1 b a
si ci
0 0 0
0 0 1
0 1 0
0 1 1
1 0 0
1 0 1
1 1 0
1 1 1
0 0
1 0
1 0
0 1
1 0
0 1
0 1
1 1
将全加器74ls183集成片插入ic空插座,输入端a、b、ci-1分别接逻辑开关k1、k2、k3,输出si和ci接发光二极管led。按全加器逻辑功能表输入逻辑电平信号,观察输出si及进位ci并记录下来。
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置d0~d7为11110000和10101010两种状态,再分别两次置地址码a3~a0为0~7,观察输出发光二极管led的状态,并记录。
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2.试用数据选择器实现全加器及比较器功能,画出具体线路图。
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