Wishbone总线的异步周期结束路径
为了实现在给定时钟频率下的最大可能吞吐量，wishbone采用了周期异步结束方式。这样做的结果是从主设备的stb_o到从设备的ack_o/err_o/rty_o再到主设备的ack_i/err_i/rty_i输入形成了一个异步回路，如图23。在大型soc设计中，该回路往往成为整个设计的关键路径，限制系统时钟频率的进一步提高。在深亚微米时代，由于线延迟往往比门延迟更大，这一异步回路更加可能成为系统性能的瓶颈。
图23 wishbone总线的异步周期结束路径
这一问题的最简单解决方法是插入寄存器将回路断开，但这样做的缺点是在每一次总线操作中都需要插入一个等待周期，从而制约了总线吞吐量。如图24所示，在上升沿0主设备发起了一次操作，在上升沿1从设备发起响应将ack_o置高，在上升沿2主设备检测到ack_i为高完成第一次操作并发起第二次操作，但是在上升沿2从设备并不知道主设备会发起第二次操作，因此只能将ack_o信号置低。在上升沿3从设备才能对第二次操作发起响应将ack_o置高，在上升沿3主设备检测到ack_i为高完成第二次操作。
图24 wishbone总线的传统同步周期结束方式
在图24中，每一次传输都需要两个时钟周期，一半的带宽被浪费。如果从设备在上升沿3知道主设备将发起新的操作，它将能够在上升沿3就对主设备的操作发起响应，从而节省时钟周期提高了系统的吞吐量，利用该思想改进后的同步时序如图25所示。
图25 wishbone总线改进的同步周期结束方式
在图25的上升沿1，主设备发起操作，在上升沿2，从设备将ack_o置高，在上升沿3，从设备知道主设备将发起新的操作，于是将ack_o继续置高。因此， 3个时钟周期就完成了2次操作，而不是原来大的4个时钟周期，于是吞吐量提高了25%。一般的，改进后，n次操作需要n+1个时钟周期，而不是2n个时钟周期，吞吐量改善为(n-1)/n%。
改进后的同步周期结束方式具备异步周期结束方式的吞吐量优势，同时具备传统同步结束方式的延迟优势。改进后的同步周期结束方式称作wishbone寄存反馈周期结束方式。
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