如何在设计阶段考虑降低XILINX的功耗
如何在设计阶段考虑降低xilinx的功耗
最近xilinx发布了不少关于使用serdes,iserdes/oserdes等基元设计一些很具创意性的接口。
如xapp1071 - connecting virtex-6 fpgas to adcs with serial lvds interfaces and dacs with parallel lvds interfaces。
xapp486 - 7:1 serialization in spartan-3e/3a fpgas at speeds up to 666 mbps
xapp485 - 1:7 deserialization in spartan-3e/3a fpgas at speeds up to 666 mbps
这些设计有一个好处：节省接口i/o的使用数量。
根据此我想到了我们在设计前期时都是要进行功耗评估的工作，我们如果经常使用xilinx xpower analyzer进行这方面的工作就会发现在fpga内部
功耗耗用情况。
进入xilinx xpower analyzer界面，打开一个工程后，选中和阅读summary那栏时，软件会列出诸如
clock、logic、signals、io、brams、dcms、dsps等资源功耗分类信息。
按照我平时的工作经验，功耗最大的一般是io(有时得到的估计值多达1w以上),它是第高层次的功耗。第二个层次是bram、dcm、dsp48（在该层次中，按由大到小排列）。
现在无线通信系统中io的数据速率越来越高，信息与外界接口电路吞吐率也变的比较大。
因此考虑使用iserdes/oserdes等基元进行设计，在一些功耗要求比较苛刻的应用场景，这种应用很有前景。
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