瑞萨e2studio(29)----SPI速率解析

概述在嵌入式系统的设计中,串行外设接口(spi)的通信速率是一个关键参数,它直接影响到系统的性能和稳定性。瑞萨电子的ra4m2微控制器为开发者提供了灵活而强大的spi配置选项,确保可以根据不同的应用场景选择最佳的数据传输速率。本文将深入探讨ra4m2微控制器的spi速率配置机制,并提供实用指南以帮助开发者实现精确的速率控制。
下面文档是瑞萨ra4m2微控制器用户手册中的一部分,显示了串行通信接口(sci)的功能和其内部模块图。
时钟来源为pclk,可以进行1、4、16、64分频。
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时钟配置spi (r_sci_spi)的时钟来自plcka。
这里使用的plcka为60mhz。
解析ra4m2的brr值为了确定适合特定pclk频率和所需spi通信速率的brr值,ra4m2用户手册提供了详尽的表格。这些表格列出了各种pclk频率与相应的spi比特率组合,并指出了相应的brr配置值。
下图显示了瑞萨ra4m2微控制器用户手册的表格27.14,它列出了在时钟同步和简单spi模式下不同比特率(bps)和操作频率(pclk)组合的brr(bit rate register)设置。
每一行代表一个特定的比特率,从110 bps到1 mbps,而每一列对应一个特定的pclk值,从8 mhz到100 mhz。在表格中,n 表示pclk分频值,而 n 是brr寄存器的设置值。例如,要在25 mhz的pclk上实现500 bps的比特率,brr应该设置为249。
这个表格对于那些需要精确控制ra4m2微控制器上sci通道比特率的开发者来说非常有用,因为它允许他们根据系统的pclk频率来查找或计算出必须写入brr寄存器的确切值。
注意的要点包括:
空格( )表示该设置是禁止的。
破折号(—)表示虽然可以设置,但可能会导致错误。
时钟速率这里,cks[1:0]的设置决定了sci的时钟分频率,即pclk的分频值。表格列出了以下选项:
00b:使用pclk作为时钟源。
01b:pclk的四分之一作为时钟源。
10b:pclk的十六分之一作为时钟源。
11b:pclk的六十四分之一作为时钟源。
每种设置都有一个对应的分频数n,它在编程时用于确定sci时钟频率。
7.5m下寄存器值plcka为60mhz,pclk=60(mhz)
手册给出对应的参数设置。
查看cks寄存器可以得知为0,n=0
brr寄存器为1,即n=1
计算spi速率为7.5m。
实际测试如下所示。
3k下寄存器值设置速率为3k。
手册未给出对应的参数设置。
plcka为60mhz,pclk=60(mhz)
查看cks寄存器可以得知为3,n=3
brr寄存器为0x4e(78),即n=78
计算spi实际速率为2966.77。
实际测试如下所示。

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