Xilinx可编程逻辑器件设计与开发（基础篇）连载30：Spartan
9.2 chipscope pro核生成器
xilinx针对不同类型的调试ip核，提供了不同的核生成器。本节重点介绍xilinx core generator tool（xilinx ip核生成器）所支持的chipscope pro调试ip核icon、ila、vio和atc2及其属性（见图9-5）。
图9-5 xilinx core generator tool的调试ip核
9.2.1 icon属性 双击【xilinx core generator】，打开现有的ip核工程项目或者建立一个新的ip核工程。【view by function】→【debug & verification】→【chipscope pro】，双击icon。弹出图9-6所示界面。
图9-6 icon配置界面
(1) 【component name】：输入组件名称。
(2) icon parameters。
【number of control ports】：icon可以连接最多15个ila、iba、vio和atc2内核。这些内核不可以分享它们的控制端口。
【disabling the boundary scan component instance】：该选项用于选择是否禁止在icon内部例化边界扫描组件，默认此项不选中，即自动在icon内部例化边界扫描组件。边界扫描原语（例如，bscan_virtex5）用于实现与目标fpga的jtag边界扫描逻辑的通信。边界扫描组件扩展了fpga的jtag测试访问接口（tap），可以产生四条扫描链，分别是user1、user2、user3和user4，chipscope analyzer是通过其中的一条与chipscope内核ip通信的。由于这些调试内核不能同时使用一个边界扫描模块中的两条扫描链，但是与其他用户逻辑共享同一个边界扫描模块是可能的。这种共享同一个边界扫描模块的方法有两种：一是在icon中例化边界扫描模块，并将未用的边界扫描链从icon输出，供其他逻辑使用；另一种方法是在设计中的其他地方例化边界扫描模块，将user1或user2扫描链与icon核接口连接。
注意：只有 spartan-3、spartan-3e、spartan-3a和spartan-3a dsp支持该选项。
【selecting the boundary scan chain】：chipscope analyzer分析仪通过一条扫描链（user1、user2、user3或者user4）与chipscope内核通信。如果边界扫描模块在icon核内例化，则可以通过【selecting the boundary scan chain】下拉列表框选择一条扫描链。
【disabling jtag clock bufg insertion】：如果边界扫描模块在icon核内例化，那么可以在jtag时钟链选择禁止插入bufg。禁止插入bufg，jtag时钟则不会使用全局时钟网络，而采用通用布线资源布线。默认值为自动分配一个bufg。如果要禁止bufg插入，那么需要在.xco文件中设臵内核参数“cset enable_jtag_bufg=false”。该选项在gui界面中不出现，需要产生该内核后手动编辑.xco文件。
注意：只有全局资源非常缺少的情况下才考虑把jtag时钟放到通用布线中。禁止全局时钟缓冲器可能导致时序问题或者不期望的行为（例如在分析工具中出现“found 0 cores in device”的错误）。
【enabling unused boundary scan ports】：如果边界扫描组件是在icon核里被例化的，那么可以选择【enabling unused boundary scan ports】复选框使能边界扫描组件的未用扫描链user*，供其他逻辑使用。spartan-3、spartan-3e、spartan-3a和spartan-3a dsp器件的边界扫描原语有两套端口：user1和user2。
virtex-4/5/6和spartan-6器件的边界扫描原语有四套端口：user1、user2、user3和user4，但是同一时刻只有一种端口使能。这些端口提供了与tap控制器的接口。icon核通常只与一个user扫描链通信，因此其他不用的端口可以用于其他逻辑。
注意：只有 spartan-3、spartan-3e、spartan-3a和spartan-3a dsp支持该选项。另外，只有使用这些user*口时此项才被使能。如果设臵为使能，但是设计中并没有使用这些端口，一些综合工具可能不会产生与icon之间的正确连接，甚至会在综合或实现阶段产生错误。
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9.2.1 icon属性 双击【xilinx core generator】，打开现有的ip核工程项目或者建立一个新的ip核工程。【view by function】→【debug & verification】→【chipscope pro】，双击icon。弹出图9-6所示界面。
图9-6 icon配置界面
(1) 【component name】：输入组件名称。
(2) icon parameters。
【number of control ports】：icon可以连接最多15个ila、iba、vio和atc2内核。这些内核不可以分享它们的控制端口。
【disabling the boundary scan component instance】：该选项用于选择是否禁止在icon内部例化边界扫描组件，默认此项不选中，即自动在icon内部例化边界扫描组件。边界扫描原语（例如，bscan_virtex5）用于实现与目标fpga的jtag边界扫描逻辑的通信。边界扫描组件扩展了fpga的jtag测试访问接口（tap），可以产生四条扫描链，分别是user1、user2、user3和user4，chipscope analyzer是通过其中的一条与chipscope内核ip通信的。由于这些调试内核不能同时使用一个边界扫描模块中的两条扫描链，但是与其他用户逻辑共享同一个边界扫描模块是可能的。这种共享同一个边界扫描模块的方法有两种：一是在icon中例化边界扫描模块，并将未用的边界扫描链从icon输出，供其他逻辑使用；另一种方法是在设计中的其他地方例化边界扫描模块，将user1或user2扫描链与icon核接口连接。
注意：只有 spartan-3、spartan-3e、spartan-3a和spartan-3a dsp支持该选项。
【selecting the boundary scan chain】：chipscope analyzer分析仪通过一条扫描链（user1、user2、user3或者user4）与chipscope内核通信。如果边界扫描模块在icon核内例化，则可以通过【selecting the boundary scan chain】下拉列表框选择一条扫描链。
【disabling jtag clock bufg insertion】：如果边界扫描模块在icon核内例化，那么可以在jtag时钟链选择禁止插入bufg。禁止插入bufg，jtag时钟则不会使用全局时钟网络，而采用通用布线资源布线。默认值为自动分配一个bufg。如果要禁止bufg插入，那么需要在.xco文件中设臵内核参数“cset enable_jtag_bufg=false”。该选项在gui界面中不出现，需要产生该内核后手动编辑.xco文件。
注意：只有全局资源非常缺少的情况下才考虑把jtag时钟放到通用布线中。禁止全局时钟缓冲器可能导致时序问题或者不期望的行为（例如在分析工具中出现“found 0 cores in device”的错误）。
【enabling unused boundary scan ports】：如果边界扫描组件是在icon核里被例化的，那么可以选择【enabling unused boundary scan ports】复选框使能边界扫描组件的未用扫描链user*，供其他逻辑使用。spartan-3、spartan-3e、spartan-3a和spartan-3a dsp器件的边界扫描原语有两套端口：user1和user2。
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注意：只有 spartan-3、spartan-3e、spartan-3a和spartan-3a dsp支持该选项。另外，只有使用这些user*口时此项才被使能。如果设臵为使能，但是设计中并没有使用这些端口，一些综合工具可能不会产生与icon之间的正确连接，甚至会在综合或实现阶段产生错误。
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