01 导言和概述
导言和概述
本数据表描述了台积电40nm ulp工艺中的tetramem adc ip。它的特点是:
占地面积小,适用于低速和多通道应用
异步架构,不需要外接高速时钟
可根据要求提供带隙
适用于模拟ai计算、温度/模拟传感器、多通道采样等应用
以下是主要规格表:
02 adc方框图
该ip的主要目标市场是物联网、模拟人工智能或温度传感器的低面积、低功耗和低速应用。以下是ip的框图:
我们设计了一个定制电容dac(cdac)阵列,其单位面积是业界最小的,可显著减少ip面积和开关能耗。此外,我们仔细调整性能敏感的电路,如比较器,基准驱动器等,以达到最佳的ppa组合。最后,我们使用了一个专有的带隙,以实现稳定的工作条件下,整个pvt的角落。
03 adc pin描述
04 adc功率性能区
总功率:52uw
vdda : 18ua x 0.9=16.2uw
avddh : 19ua x 1.8= 36uw
跨pvt角落的enob:7.3位
面积:7.76um x 120um = 931um2
walden fom = p /( fs x2 ^ enob )= 52u / (10m x 2 ^7.3)= 34fj/凸步
05 硅表征结果
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06 晶体管/金属使用
核心晶体管:lvt、ulvt
高压晶体管:1.8v晶体管
电容器:定制mom和铸造pdk mom
金属化:1p6m
电源:0.9v(铁芯),1.8v(高压)
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