同步D触发器原理
为了避免同步rs触发器的输入信号同时为1，可以在s和r之间接一个“非门”，信号只从s端输入，并将s端改称为数据输入端d，如图15-8所示。这种单输入的触发器称为同步d触发器，也称d锁存器。
由图可知，s=d，r=当cp=0时，触发器的状态q维持不变。当cp=1时，若d=1，则s=1，
r==0，故qn+1=1；若d=0，则s=0，r=s=1，故qn+1=0。由此得到同步d触发器的状态转移真值表13-6,由状态转移真值表可直接列出同步d触发器的状态方程qn+1=d
同步d触发器逻辑功能表明：只要向同步触发器送入一个cp，即可将输入数据d存入触发器。cp过后，触发器将存储该数据，直到下一个cp到来时为止，故可锁存数据。这种触发器同样要求cp=1时，d保持不变。
同理可得同步d触发器在cp=1时的激励表如表13-7所示，状态转移图如图13-9所示。
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