VHDL的基本描述语句设计
实验六、vhdl的基本描述语句设计
一 实验目的
1掌握vhdl语言的基本结构及设计的输入方法。
2掌握vhdl语言的基本描述语句的使用方法。
二 实验设备与仪器
1 计算机
2 max+plusⅱ工具软件
3 eda–v型实验箱
4 编程器件：flex10k10lc84-4
三 实验内容
设计并实现一个4-16译码器
四 实验原理
常用的译码器有：2-4译码器、3-8译码器、4-16译码器，下面我们用一个3-8译码器的设计来介绍译码器的设计方法。
3-8译码器如图11-1所示，其真值表请参阅教材。
图6-1 3-8译码器
下面我们用vhdl语言来描述一个3-8译码器。
第一种：
library ieee;
use ieee.std_logic_1164.all;
entity decoder3_8 is
port(
a, b,c,g1,g2a,g2b: instd_logic;
y: outstd_logic_vector(7 downto 0));
end decoder3_8;
architecture fun of decoder3_8 is
signal indata: std_logic_vector(2 downto 0);
begin
indata yyyyyyyyy<=xxxxxxxx;
end case;
else
y<=11111111;
end if;
end process encoder;
end fun;
五 实验步骤
1 请参考以上程序设计一4-16译码器。
2 将编辑好的4-16译码器进行编译和仿真。
3输入信号接实验箱的拨码开关，输出信号接发光二极管。改变拨码开关的状态，观察实验结果。
4将byteblaster电缆的一端与计算机的并行口相连，另一端10针阴头与实验板的插座相连。
5 选择菜单命令options/hardware setup，出现图3-67所示设置编程硬件对话框。在hardware type栏的下拉条中选择byte blaster；
6 单击configure按钮，即开始配置器件。若器件或电缆或电源有问题，则会产生错误警告信息。
六 记录实验结果并完成实验报告
记录实验结果。同时编程完成2-4译码器，同前，对译码器造表，得到其真值表，并分析其运算结果的正确性。
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3-8译码器如图11-1所示，其真值表请参阅教材。
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port(
a, b,c,g1,g2a,g2b: instd_logic;
y: outstd_logic_vector(7 downto 0));
end decoder3_8;
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signal indata: std_logic_vector(2 downto 0);
begin
indata yyyyyyyyy<=xxxxxxxx;
end case;
else
y<=11111111;
end if;
end process encoder;
end fun;
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1 请参考以上程序设计一4-16译码器。
2 将编辑好的4-16译码器进行编译和仿真。
3输入信号接实验箱的拨码开关，输出信号接发光二极管。改变拨码开关的状态，观察实验结果。
4将byteblaster电缆的一端与计算机的并行口相连，另一端10针阴头与实验板的插座相连。
5 选择菜单命令options/hardware setup，出现图3-67所示设置编程硬件对话框。在hardware type栏的下拉条中选择byte blaster；
6 单击configure按钮，即开始配置器件。若器件或电缆或电源有问题，则会产生错误警告信息。
六 记录实验结果并完成实验报告
记录实验结果。同时编程完成2-4译码器，同前，对译码器造表，得到其真值表，并分析其运算结果的正确性。
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