关于Vivado Non-project，我们应知道的一些问题
vivado支持project模式也支持non-project模式。两者既可以支持图形界面也支持tcl命令，但用到的tcl命令是不同的，不能混用。通常，project模式应用更广，便于初学者学习，同时也便于工程管理。non-project模式编译时间会比project模式短，因为所有数据存储在内存，直接内存读取数据比硬盘读取要快一些。这里我们探讨一下使用non-project模式时可能碰到的一些问题。
如何读取systemverilog文件?
在non-project模式下，可以通过read_*命令将设计用到的文件添加到工程中，例如：read_verilog可读取设计所需的verilog文件(文件后缀为.v或.vh)，当为.vh时，表明该文件为verilog header文件，在non-project模式下并不需要特别指明。但是如果读取的是systemverilog文件(文件后缀为.sv)或者使用了systemverilog语法的verilog文件时，就需要在read_verilog命令后添加选项-sv。
如何读取vhdl-2008文件?
类似地，可以通过read_vhdl读取设计所需的vhdl文件，文件后缀为.vhd。但如果vhdl文件使用了vhdl-2008语法，在使用该命令时就要添加选项-vhdl2008。
如何同时读取多个同类型的设计源文件?
使用non-project模式时，通常建议将所有的待综合的hdl文件无论是verilog/vhdl/systemverilog放在同一个文件目录下，例如放置在src/hdl目录下，这样可以方便地对同一类文件进行快速读取。例如，读取所有的vhdl文件可用如下命令，这里使用了tcl命令glob，这种情况下该命令可返回所有的vhdl文件。如果要读取所有的verilog文件，就用glob ./src/hdl/*.v即可。 read_vhdl [glob ./src/hdl/*.vhd]
如何处理ip?
设计中我们不可避免地会用到ip，无论是project模式还是non-project模式，都建议创建ip工程，以单独管理ip，如下图所示，这对于后续维护和升级ip都大有裨益。
ip即可采用全局综合方式，又可采用ooc综合方式，这在生成ip输出文件时就要确定，也只能在此界面确定而无法通过属性修改，如下图所示。
可以通过命令read_ip读入ip，但该命令只能读入.xci文件，并不会读入预先生成的dcp文件。如果已在ip工程中完成了对ip的ooc综合，那么无需在non-project模式下再次对ip进行综合。否则，要先对ip通过命令synth_ip进行ooc综合，此时要用到如下两个命令。get_ips后也可跟随具体的ip名称。执行了synth_ip之后才可以对整个设计执行综合。
generate_target all [get_ips]
synth_ip [get_ips] -force
在non-project模式下对ip通过synth_ip执行ooc综合时，要先指定芯片型号，否则工具会按默认的芯片型号进行综合。指定芯片型号要用set_part命令，如下所示：
set_part [get_parts xcku035-fbva900-2-e]
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如何读取vhdl-2008文件?
类似地，可以通过read_vhdl读取设计所需的vhdl文件，文件后缀为.vhd。但如果vhdl文件使用了vhdl-2008语法，在使用该命令时就要添加选项-vhdl2008。
如何同时读取多个同类型的设计源文件?
使用non-project模式时，通常建议将所有的待综合的hdl文件无论是verilog/vhdl/systemverilog放在同一个文件目录下，例如放置在src/hdl目录下，这样可以方便地对同一类文件进行快速读取。例如，读取所有的vhdl文件可用如下命令，这里使用了tcl命令glob，这种情况下该命令可返回所有的vhdl文件。如果要读取所有的verilog文件，就用glob ./src/hdl/*.v即可。 read_vhdl [glob ./src/hdl/*.vhd]
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可以通过命令read_ip读入ip，但该命令只能读入.xci文件，并不会读入预先生成的dcp文件。如果已在ip工程中完成了对ip的ooc综合，那么无需在non-project模式下再次对ip进行综合。否则，要先对ip通过命令synth_ip进行ooc综合，此时要用到如下两个命令。get_ips后也可跟随具体的ip名称。执行了synth_ip之后才可以对整个设计执行综合。
generate_target all [get_ips]
synth_ip [get_ips] -force
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