MC8051 IP核基本结构及原理
mc8051是与mcs一5l系列微处理器指令集完全兼容的8位嵌入式微处理器，通过芯核重用技术，可广泛应用在一些面积要求比较苛刻，而对速度要求不是很高的片上系统中。
1 mc8051功能特点
采用完全同步设计：指令集和标准8051微控制器完全兼容;指令执行时间为l～4个时钟周期，执行性能优于标准805l微控制器8倍左右;用户可选择定时/计数器、串行接口单元的数量，最多可增加到256组;新增特殊功能寄存器用于选择不同的定时/计数器、串行接口单元;可选择是否使用乘法器(乘法指令mul);可选择是否使用除法器(除法指令div);可选择是否使用十进制调整功能(十进制调整指令da);i/0口不复用，无双向数据i/o端口，输入、输出端口独立;内部带256byte ram;⑾最多可扩展至64 kb的rom和64 kb的ram;与工艺无关，可通过修改vhdl源代码扩展及参数化设置。
2 mc8051结构及设计层次
图1给出mc805l_eore的顶层设计模块及其子模块，包括顶层的各个信号端口及3个存储器模块。同时给出了顶层的输入输出i/o口。定时/计数器和串行接口单元，对应于图中的mc805l_tmrctr和mc8051_siu模块，数量可选择，图中用虚线表示。mc8051 ip核与工业标准8051单片机不同，mc8051的输入、输出并口分别映射到独立的端口上。其顶层各i/o信号的描述如表l所示。
mc805lip核的设计层次及对应的vhdl文件如图2所示嘲。它由定时/计数器、alu算数逻辑单元、串行接口单元和控制单元组成。ram及rom模块不包括在ip核内，处于设计的顶层，方便于不同的应用设计及仿真。
图2中，最顶层是用户的实际应用设计模块，它将rom、ram及mc8051_core封装在内部。实际应用中用户可添加自定义附加逻辑模块，与设计层次中的ram、rom模块处于同一个层次。
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