基于1553B总线和ARINC429总线的数据格式介绍
引言
在航空领域，1553b总线和arinc429总线是应用较为广泛的两种总线标准，载机航电系统较多应用1553b总线，而机载武器系统则较多应用arinc429总线，作为武器系统和航电系统通信控制中介的发射装置则需对两种总线标准进行数据转换。现将两种总线数据格式进行简单介绍。
1）gjb1553b总线简介
gjb1553b数据总线采用manchester编码解码协议，以异步、命令/响应方式执行数据传输，通常采用半双工方式，其传输速率为1mbit/s.manchester码与常用的不归零码（nrz）的编码不同，在电路中，nrz码的“0”用低电平表示；manchester码的“0”用由低到高的电平跳变表示。同理，nrz码的“1”用高电平表示；manchester码的“1”用由高到低的电平跳变表示。在实际应用中采用差分manchester码。差分manchester码与不归零（nrz）的波形对照如图1所示。
2）arinc 429 简介
arinc429总线是目前应用较多的机载航空总线之一，它是一种单向是一种单向广播式总线，其信息传输速率为12.5~100kbit/s[2].arinc429规定数据传输采用双极性归零码（如图2所示），即调制信号有“高”、“零”、“低”状态组成，传输介质为双绞屏蔽电缆。
1 基于fpga的转换电路硬件设计
数据转换核心工作是对各种总线标准的数据进行编解码。在传统数据转换电路中，一般先由各种总线标准的专业编辑码芯片对数据进行编解码，再对数据进行处理，传统的转换电路设计较为简单，但功耗较高，可编程逻辑的资源未能充分利用。现介绍一种基于fpga的数据转换电路设计。
数据转换硬件电路设计：
数据转换电路主要包括fpga、dsp和外围驱动调理电路。其中dsp控制各模块工作时序，fpga负责曼码编解码、dsp外围控制逻辑、数据格式转换、时钟信号产生及数据暂存等功能实现，数据存储在高速低功耗的cmos静态ram中。数据转换电路硬件设计框图如图3所示。
考虑到电路各模块间数据通讯，数据线需要占用大面积的pcb空间，切高速信号间可能产生串扰。故在此处我们将1553b芯片的编解码部分集成到fpga中，外围通过模式变压器和简单的整形电路将数据电平调理到适合fpga接收的范围。这样可以降低整个数据转换电路的功耗，提高cpu控制板的集成度，减小发热量，简化pcb板的布线，提高整个系统的稳定性。
2 系统仿真验证
整个fpga功能模块采用verilog语言进行集成，利用fpga仿真工具对设计中的关键信号和模块进行仿真可极大节省开发时间，提高系统运行的稳定性，降低开发成本。
1）gjb1533b数据转换实现
gjb1553b数据采用曼彻斯特编码，要实现数据转换必须对曼码进行解码，曼彻斯特编码解码逻辑电路由同步头识别逻辑电路、数据采样逻辑电路和译码逻辑电路构成。同步头的识别较为关键，如果不能正确的识别可能导致命令丢失或者参数设置错误。在此我们采用的技术是：数据采样逻辑电路时钟监测数据输入线路，把数据输入线路上的电平的跳变作为一个触发事件，这个触发事件是否有效由以下条件决定：
如果在后来采集到的数据队列中连续存在1.5位的低电平和两个有效的manchester码位，就认为命令字同步头有效；如果在后来采集到的数据队列中连续存在1.5位的高电平和两个有效的manchester码位，就认为数据字同步头有效。在随后连续收到17位manchester码，最后一位是奇校验位，如果奇校验位正确，说明收到一个正确完整的字，这个十六位字是命令字还是数据字由同步头的格式确定。
在fpga中进行仿真，其波形如图4所示。
由图可以看出，在fpga内部曼彻斯特码顺利转换了计算机通用的二进制数据。
2）arinc429数据转换实现
arinc429数据的基本信息单元是由32位构成的一个数据字，每个数据字被分为5组，即： 第1~8位为标志位（label）、第9~10位为源/目的识别位（sdi）、第11~29位为数据区（data）、第30~31位为符号位（ssm）、第32位为奇偶校验位（parity）。实际上，arinc429对数据位的使用在很大程度上可以由系统设计者自己定义，在32bit串行传输的基本特征下，只要收发双方使用相同的约定即可。根据429数据格式在fpga中用verilog语言对编解码格式进行集成，其仿真波形如图5所示。
由图可以看出， 在f p g a 内部arinc429数据顺利转换了计算机通用的二进制数据。
3 结语
通过仿真可以看到， g j b 1 5 5 3 b 和arinc429在fpga内部经过各自编解码模块解码后都准确稳定地转换为二进制数据，由于verilog语言的强移植性，编解码模块可直接移植到其他模块达到两种总线数据的通信传输。
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1）gjb1553b总线简介
gjb1553b数据总线采用manchester编码解码协议，以异步、命令/响应方式执行数据传输，通常采用半双工方式，其传输速率为1mbit/s.manchester码与常用的不归零码（nrz）的编码不同，在电路中，nrz码的“0”用低电平表示；manchester码的“0”用由低到高的电平跳变表示。同理，nrz码的“1”用高电平表示；manchester码的“1”用由高到低的电平跳变表示。在实际应用中采用差分manchester码。差分manchester码与不归零（nrz）的波形对照如图1所示。
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数据转换电路主要包括fpga、dsp和外围驱动调理电路。其中dsp控制各模块工作时序，fpga负责曼码编解码、dsp外围控制逻辑、数据格式转换、时钟信号产生及数据暂存等功能实现，数据存储在高速低功耗的cmos静态ram中。数据转换电路硬件设计框图如图3所示。
考虑到电路各模块间数据通讯，数据线需要占用大面积的pcb空间，切高速信号间可能产生串扰。故在此处我们将1553b芯片的编解码部分集成到fpga中，外围通过模式变压器和简单的整形电路将数据电平调理到适合fpga接收的范围。这样可以降低整个数据转换电路的功耗，提高cpu控制板的集成度，减小发热量，简化pcb板的布线，提高整个系统的稳定性。
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