TMS320F28335学习之中断和定时器的相关内容
前言本次总结为中断和定时器的相关内容。除了基本的寄存器配置，初始化，中断主要是掌握三级中断制，定时器主要关注定时器的工作原理和中断时间的设置。
时钟定时器时钟使能为外设时钟控制寄存器pclkcr3的第8位。
sysctrlregs.pclkcr3.bit.cputimer0enclk = 1; // cpu timer 0
1 中断f28335内部有16个中断线，分别是：
1、2个不可屏蔽中断：reset、nmi；
2、14个可屏蔽中断：int1-int12，外部中断和内部单元使用；int13和int14 预留给实时操作系统。
当前主要学习int1-int12这12 个中断。
cpu级中断有12个中断线（int1-12），通过pie控制器进行复用管理，将外设中断分成12组，每一组有8个外设级中断组成，共有96个外设级中断，分别对应相应外设接口的中断引脚，实际有效外设中断为58个，其余为保留。
1.1 三级中断制：三级中断制：
外设级中断 ——> pie级中断 ——> cpu级中断
使用中断时主要需要注意各级中断的标志、使能、应答寄存器，具体如下图的标号所示：
外设级： if、ie；
pie级： pieifrx、pieierx.y、pieack；
cpu级： ier、ifr、intm。
见figure6-6。
一般当有中断请求时，if和ifr等寄存器是硬件自动置位，ie和ier等寄存器是软件使能。
中断的过程：
如下图，可以依据figure6-1和figure6-2进行理解。
外设级： 当有外设级中断产生，外设中断标志寄存器if硬件自动置位，同时外设中断使能寄存器ie软件使能（置1）后，向pie控制器发出中断申请；
pie级： 有pie中断时，pie级中断标志位pieifrx硬件自动置位，使能位pieierx.y软件使能（置1），pieack为0，此时pie可从终端组向cpu发送中断，pieack硬件置1，中断组的中断向量已向cpu发送了中断请求，中断到cpu。
cpu级： 有中断请求时，cpu级中断标志寄存器ifr硬件置1，cpu级中断使能寄存器ier软件使能（置1），全局中断屏蔽位intm使能（0-使能，cpu可响应；1-失能，cpu不响应），此时cpu响应中断，清除ier，ifr=0（软件清除/自动清零），cpu从pie获取向量（isr地址），清除pieifrx（中断响应后自动清零、写0也可清零）,cpu调到isr执行中断程序，isr程序，通过向相应中断位写1到pieackx让该位清零，清除pieifrx中使能的中断，重新使能中断，intm=0。
2 定时器定时器主要总结timer0的使用，包括定时器工作原理以及定时时间的设置。
2.1 定时器工作原理定时器组成如下图所示：
定时器工作原理如下图figure3-19定时器功能框图以及流程图所示：
由定时器流程图可知，定时器周期寄存器（prdh：prd）的值为软件设置的定时器频率* 定时器周期（freq*period）的值，定时器周期值在每一个定时器周期开始之前会装载到计数寄存器（timh：tim）中。而计数寄存器的值递减又和预分频模块有关，即和定时器分频寄存器（tddrh：tddr）和预定标计数器（psch：psc）有关。
定时器分频寄存器（tddrh：tddr）和预定标计数器（psch：psc）主要决定定时器源时钟周期，psch：psc和tddrh：tddr等于0时，系统时钟即为定时器源时钟，见外设时钟框图和figure3-19，可知即每一个定时器源时钟周期（1/150m），timh：tim减1。
每隔（tddrh：tddr+1）个定时器源时钟周期，定时器计数寄存器减1。若psch：psc和tddrh：tddr等于0时，一个定时器源时钟周期后，重新将tddrh：tddr的值装载到psch：psc，timh：tim减1。
2.2 定时时间计算中断时间t：0.5s，即500ms
t = freq * period / 150 000000 (s)
其中freq 为定时器频率150（mhz）；period 为定时器周期值，计算得来
period = 150 000000 * 0.5 / 150 = 50 0000
小结本次总结主要讲述了中断的三级中断制，包括其中断过程中相关定时器的设置；定时器讲述了定时器工作原理和中断时间的设置。这是在学习过程中需要主要了解的内容，掌握这些内容后基本可以完成定时器0的中断实验。
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2、14个可屏蔽中断：int1-int12，外部中断和内部单元使用；int13和int14 预留给实时操作系统。
当前主要学习int1-int12这12 个中断。
cpu级中断有12个中断线（int1-12），通过pie控制器进行复用管理，将外设中断分成12组，每一组有8个外设级中断组成，共有96个外设级中断，分别对应相应外设接口的中断引脚，实际有效外设中断为58个，其余为保留。
1.1 三级中断制：三级中断制：
外设级中断 ——> pie级中断 ——> cpu级中断
使用中断时主要需要注意各级中断的标志、使能、应答寄存器，具体如下图的标号所示：
外设级： if、ie；
pie级： pieifrx、pieierx.y、pieack；
cpu级： ier、ifr、intm。
见figure6-6。
一般当有中断请求时，if和ifr等寄存器是硬件自动置位，ie和ier等寄存器是软件使能。
中断的过程：
如下图，可以依据figure6-1和figure6-2进行理解。
外设级： 当有外设级中断产生，外设中断标志寄存器if硬件自动置位，同时外设中断使能寄存器ie软件使能（置1）后，向pie控制器发出中断申请；
pie级： 有pie中断时，pie级中断标志位pieifrx硬件自动置位，使能位pieierx.y软件使能（置1），pieack为0，此时pie可从终端组向cpu发送中断，pieack硬件置1，中断组的中断向量已向cpu发送了中断请求，中断到cpu。
cpu级： 有中断请求时，cpu级中断标志寄存器ifr硬件置1，cpu级中断使能寄存器ier软件使能（置1），全局中断屏蔽位intm使能（0-使能，cpu可响应；1-失能，cpu不响应），此时cpu响应中断，清除ier，ifr=0（软件清除/自动清零），cpu从pie获取向量（isr地址），清除pieifrx（中断响应后自动清零、写0也可清零）,cpu调到isr执行中断程序，isr程序，通过向相应中断位写1到pieackx让该位清零，清除pieifrx中使能的中断，重新使能中断，intm=0。
2 定时器定时器主要总结timer0的使用，包括定时器工作原理以及定时时间的设置。
2.1 定时器工作原理定时器组成如下图所示：
定时器工作原理如下图figure3-19定时器功能框图以及流程图所示：
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每隔（tddrh：tddr+1）个定时器源时钟周期，定时器计数寄存器减1。若psch：psc和tddrh：tddr等于0时，一个定时器源时钟周期后，重新将tddrh：tddr的值装载到psch：psc，timh：tim减1。
2.2 定时时间计算中断时间t：0.5s，即500ms
t = freq * period / 150 000000 (s)
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period = 150 000000 * 0.5 / 150 = 50 0000
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