简析Zynq芯片中PS和PL之间的9个双向读写的通信端口
zynq芯片中，ps（processorsystem）和pl（programmable logic）之间提供了一共9个双向读写的通信端口，他们分别是：
m_gp0 &m_gp1
s_gp0 &s_gp1
s_axi_hp0-3
s_axi_acp
这些端口的特性和适合的使用场景都不太一样，其中m_gp适合cpu和fpga之间少量的数据通信，s_hp用来进行大批量的数据交互，s_gp很少用到，s_acp同s_hp类似，但是它可以保证cpu和ddr3之间的cache一致性。
那么这些接口实际使用时，它们能提供的最大吞吐量如何呢，下标给出了一个实测的数据：
注： cpu频率667mhz，cpu clockratio为6:2:1，ddr date rate1066mhz，pl-ps axi clock 150mhz
s_acp和s_hp的数据比较接近
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