74ls161中文资料_74ls161计数器功能及其应用
74ls161计数器是目前比较常见的计数器。
74ls161引脚图及真值表
74ls161功能
74ls161功能表
从功能表的第一行可知，当cr=0（输入低电平），则不管其他输入端（包括cp端）状态如何，四个数据输出端qn、qn、qc、qn全部消零。由于这一清零操作不需要时钟脉冲cp配合（即不管cp是什么状态都行），所以为异步清零端，且低电平有效，也可以说该计数器具有“异步清零”功能。
从功能表的第二行可知，当cr=1且西=0时，时钟脉冲cp上升沿到达，四个数据输出端qa、qn、qc、qp同时分别接收并行数据输入信号a、b、c、d。由于这个置数操作必须有cp上升沿配合，并与cp上升沿同步，所以称那么该芯片具有“同步置数”功能。
从功能表的第三行可知，当ld=cr=1，ctr=ctp=1时，则对计数脉冲cp实现同步十进制加计数。
而从功能表的第四行又知道，当cr=ld=1时，只要ctr和enp中有-一个为0，则不管cp状态如何（包括上升沿），计数器所有数据输出都保持原状态不变。因此，ctr和ctp应该为计数控制端，当它们同时为1时，计数器执行正常同步计数功能;而当它们有一个为0时，计数器执行保持功能。
另外，进位输出qcc=ctrqo.qr.q2.q;表明，进位输出端仅当计数控制端ctr=1且计数器状态为15时它才为1，否则为0。
74ls161应用 60进制同步加法计数器 用同步加法计数器74ls161（或74ls160）和二4输入与非门74ls20构成百以内任意进制计数器，并采用led数码管显示计数进制。采用555定时器构成多谐振荡电路，为同步加法计数器提供时钟输入信号。
加法计数器设计（清零法） 74ls161为十六进制四位二进制加法计数器，异步清零，同步置数。
设计60进制的加法计数器，采用清零法。60用二进制表示为00111100，因为是异步清零，当计数器从零开始计数时，计数到00111100时异步清零即可。要用到两片74ls161，需要两计数器进行级联，采用同步并行级联方式。其中et和ep都接高电平。低片计数到1100，且高片计数到0011时异步清零，用四输入与非门连接，输出接到端。
多谐振荡器设计 多谐振荡器所给器件中有510k电阻2个，用来做多谐振荡器的外接电阻，电容选用103电容，则多谐振荡器的周期为：
则用555构成的多谐振荡电路为：
用74ls161构成十进制计数器
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74ls161功能
74ls161功能表
从功能表的第一行可知，当cr=0（输入低电平），则不管其他输入端（包括cp端）状态如何，四个数据输出端qn、qn、qc、qn全部消零。由于这一清零操作不需要时钟脉冲cp配合（即不管cp是什么状态都行），所以为异步清零端，且低电平有效，也可以说该计数器具有“异步清零”功能。
从功能表的第二行可知，当cr=1且西=0时，时钟脉冲cp上升沿到达，四个数据输出端qa、qn、qc、qp同时分别接收并行数据输入信号a、b、c、d。由于这个置数操作必须有cp上升沿配合，并与cp上升沿同步，所以称那么该芯片具有“同步置数”功能。
从功能表的第三行可知，当ld=cr=1，ctr=ctp=1时，则对计数脉冲cp实现同步十进制加计数。
而从功能表的第四行又知道，当cr=ld=1时，只要ctr和enp中有-一个为0，则不管cp状态如何（包括上升沿），计数器所有数据输出都保持原状态不变。因此，ctr和ctp应该为计数控制端，当它们同时为1时，计数器执行正常同步计数功能;而当它们有一个为0时，计数器执行保持功能。
另外，进位输出qcc=ctrqo.qr.q2.q;表明，进位输出端仅当计数控制端ctr=1且计数器状态为15时它才为1，否则为0。
74ls161应用 60进制同步加法计数器 用同步加法计数器74ls161（或74ls160）和二4输入与非门74ls20构成百以内任意进制计数器，并采用led数码管显示计数进制。采用555定时器构成多谐振荡电路，为同步加法计数器提供时钟输入信号。
加法计数器设计（清零法） 74ls161为十六进制四位二进制加法计数器，异步清零，同步置数。
设计60进制的加法计数器，采用清零法。60用二进制表示为00111100，因为是异步清零，当计数器从零开始计数时，计数到00111100时异步清零即可。要用到两片74ls161，需要两计数器进行级联，采用同步并行级联方式。其中et和ep都接高电平。低片计数到1100，且高片计数到0011时异步清零，用四输入与非门连接，输出接到端。
多谐振荡器设计 多谐振荡器所给器件中有510k电阻2个，用来做多谐振荡器的外接电阻，电容选用103电容，则多谐振荡器的周期为：
则用555构成的多谐振荡电路为：
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