缩减先进制程IC设计时程 新思原型验证平台登场
为节省先进制程ic设计成本，新思科技(synopsys)宣布推出新一代haps-80 fpga原型建造系统。该系统搭配protocompiler设计自动化和除错软件，并采用赛灵思(xilinx)最新的现场可编程门阵列(fpga)组件，可大幅提升软件开发、硬件/软件整合，以及系统验证的速度。
新思科技资深产品营销经理neil songcuan表示，整合型原型验证解决方案可大幅缩短ic开发时间、缩短除错周期、执行更多测试、支持更大量的设计和更多软件，以及缩短重复设计时间。
据悉，物理原型解决方案(physical prototyping solutions)，必须着重在ic设计开发的五大面向关键挑战，包括fpga制图描绘、除错的可视性、平台、容量问题，以及周转时间。
而新思科技新推出的haps-80 fpga原型建造系统，搭配protocompiler软件，可创造高达100mhz的多重fpga效能，及可自动化分割(partitioning)作业，将最初原型的平均开发时程缩短至两周以内；此外，在赛灵思virtex ultrascale fpga作为组件的基础下，该系统配置(configurations)可支持高达十六亿asic逻辑闸的设计，实现远程使用与并行执行的多任务设计模式。
新产品还内建除错功能，提升除错效率和辨别性，可撷取数千笔缓存器转移层次(rtl)讯号，并透过新思「连续验证平台(verification continuum platform)」中vcs仿真工具之「统一编译」及verdi除错工具之「统一除错」，简化模拟、仿真和原型建造的反复流程，大幅缩短数月的设计和验证时程。
新思科技资深产品经理韩良栋指出，对ic设计公司而言，原型验证已愈来愈关键。其原因在于，若在原型验证的阶段，能准确除错，对先进制程的企业来说，可省下相当多的光罩支出成本，因此原型验证在未来先进制程的ic设计上，其重要性与必要性将会逐渐增加。
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