基于FPGA的原型，具备最高性能和可扩展容量
haps-70 系列是一款易于使用、具备成本效益的基于 fpga 的原型验证系统。 haps-70 系列利用高速的实际接口，能够以接近实时的运行速度，实现早期的硬件/软件集成和系统级验证。
增强的 haps 系统，采用最新 xilinx virtex?-7 fpga，为使用 haps-70 系列的设计人员提供超强容量、性能和先进验证模式。 借助 haps-70 系列，soc 设计人员将能够以更快的速度构建下一代设计，同时风险更小、利润更高。
haps-70 功能：
模块化的系统架构，适应1200万门到2.88亿门范围的设计规模， 从单独的ip模块到处理器子系统及完整的soc。对于容量在50万到4百万asic门的系统，参见haps developer express(haps-dx)系列。对于容量超过2.88亿门的系统，参见haps-80系列。
将增强的 hapstrak 3 i/o 连接器技术与高速时域复用相结合，可提供比传统的引脚复用技术高达 3 倍的数据性能改善
系统定义和启动工具加速硬件组装，确保原型的机电完整性
先进的电源和散热管理
设计规划工具使原型设计时间减少 2-3 个月，简化从模块级 ip 验证到全系统集成的流程
提高调试效率，可视性提高 100 倍，调试跟踪缓冲数据下载时间加快 8 倍
先进的使用模式，包括协同仿真、基于事务的验证和混合原型验证
haps-70 基于 fpga 的原型验证系统可提供九种型号的产品系列，容量从 1200 万 到 2.88 亿个 asic 门
兼容designware ip原型验证套件
haps 硬件配件和软件
protocompiler
优势：
高性能
haps 系列可提供从独立 ip 模块到整个 soc 系统（集成了各 cpu 子系统）范围内各种不同场景下的验证，凭借其卓越的性能，成为业界领先产品。 观看 synopsys 高级副总裁兼 solution group 总经理 joachim kunkel 的视频，了解 synopsys 的下一代基于 fpga 的原型验证系统 haps-70 系列。
haps-70 介绍视频
可扩展容量
haps-70 系列系统采用模块化硬件架构以及最新大容量 fpga 技术，可支持从 12m 到 288m 个 asic 门的 soc 设计。
深度可视性
提供 fpga 间的无缝调试可视性，以及一系列跟踪存储选项，让您能够深入访问并控制原型资源，同时将对其造成的影响降至最低。
haps 深度跟踪调试视频
轻松启动
来自行业领先 eda 供应商的 ip 和 asic rtl 移植技术，让您能够更加轻松地提供高性能原型。
连接选项
独立的基于 fpga 的原型的优势显而易见，而 haps-70 协同仿真和基于事务的验证连接则可简化从 rtl 仿真环境移植的操作，实现集成了 systemc/tlm 模型的混合系统，从而获得最快的 soc 原型启动。
设计规划：
haps 特定的设计规划功能
不管原型验证项目的规模大小如何： 可以是一个ip， 一个子系统， 或一个完整的soc， 用于创建基于fpga的原型的设计规划工具必须在快速bring-up方面进行优化。设计准备和规划是一个很耗时的任务， 可能的瓶颈来自：
多次反复和较长的编译时间，延长了对ip和hdl的检查；
设计中的门控时钟和产证时钟需要转换为与fpga架构一致的时钟，这非常耗费时间；
人工找到一种可能的跨多个fpga的分割方案；
项目的设计变动导致的重建原型也非常耗时；
对haps-70系列来说，protocompiler原型验证工具可以帮助减少建立第一个原型的时间， 它的自动化功能包括：
多种hdl编译模式，可以尽可能多的提升hdl源码检查的效率；
多种时钟转换选项，可以专注于快速的运行时间或最佳的系统性能；
fpga分割和综合的并行处理模式；
快速并自动化的约束驱动的分割和系统级的布线；
虚拟的无限的容量
灵活的数据库模型允许快速的反复；
有效的基于tcl的命令行界面；
自动的时域复用，在xilinx virtex-7的高速管脚上实现；
要获取更多有关protocompiler的自动化功能
连接和调试：
特定的连接和调试功能
protocompiler?rtl 调试工具和?将 haps 连接至主机工作站，进行系统监控、rtl 调试和先进的验证。 除了简化 fpga 的 rtl 调试功能外，紧密集成 haps 系统还使 synopsys 能够为大容量调试和系统连接提供以下独特解决方案：
可迅速装配和检验多母板和子板系统的完整性，haps-aware 硬件查询功能可以用来检验时钟的有效性，hstdm 的连接性和 umrbus 的连接性。
应用采样存储容量高达8gb的haps deep trace debug(haps dtd)
通过 haps 与带有 haps umrbus 接口的主机工作站之间的数据流，提高原型状态可视性
采用外部逻辑分析器，进行复杂触发和大容量样点存储。 haps real time debug(rtd)功能， 配合使用 haps mictor 子板，可以调试rtl，然后轻松编程并将 agilent 或 tektronix 逻辑分析器连接至 haps 系统
故障排除和调试更加轻松
更多关于?haps deep trace debug?以及能帮助您排除基于 fpga 的原型故障和快速隔离 rtl 错误的其他synopsys工具。
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haps-70 功能：
模块化的系统架构，适应1200万门到2.88亿门范围的设计规模， 从单独的ip模块到处理器子系统及完整的soc。对于容量在50万到4百万asic门的系统，参见haps developer express(haps-dx)系列。对于容量超过2.88亿门的系统，参见haps-80系列。
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兼容designware ip原型验证套件
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protocompiler
优势：
高性能
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可扩展容量
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深度可视性
提供 fpga 间的无缝调试可视性，以及一系列跟踪存储选项，让您能够深入访问并控制原型资源，同时将对其造成的影响降至最低。
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轻松启动
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连接选项
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