Spartan6开发中bufpll mapping error
最近阅览博客时发现有一篇可以举一反三的文章，转来与大家共分享。
《spartan6开发中bufpll mapping error 》
最近在做spartan6上的视频输出，输出的接口是hdmi接口，要求格式是720p。
系统的时钟主要有
750m（s输出的io输出时钟，必须接bufpll）
75m（720p的像素时钟）
150m
100m （系统时钟）
24m （外围设备需要的时钟）
工具用的是ise12.2
通过ise自带的clock_wizard来生成需要的时钟，750m是专门用来做t m d s的io输出时钟，主要端口定义如下：
--clock_gen是通过clock_wizard自动生成的。
clock_gen_inst : clock_gen
port map(
clk_in1 => sys_clk_in,
reset => sys_rst,
locked => locked,
clk_out1 => pix_clkx10_pll, --750m, need bufpll as buffer
clk_out2 => pix_clk_pll, --75m
clk_out3 => pix_clkx2_pll, --150m
clk_out4 => sys_clk， --93.75m
clk_out5 => external_clk_buf );
而pix_clkx10_pll必须添加bufpll，bufpll定义如下；
bufpll #(
.divide(5)
)
tx_bufpll_inst(
.ioclk(tx_clkx10),
.locked(locked),
.lock(lock),
.pllin(pix_clkx10),
.gclk(pix_clkx2),
.serdesstrobe(tx_serdesstrobe));
原理图见图1.
按照上面的时钟定义在mapping的时候出现这样的error：
ror:place - constraintresolved no placeable site for u2/tx_bufpll_inst
error:place - sio has over-constrained componet u2/tx_bufpll_inst to have to placeable sites. constraints come from
driver constraints and load io constraints
phase 4.2 initial placement for architecture specific features (checksum:fc8413ca) real time: 38 secs
total real time to placer completion: 38 secs
total cpu time to placer completion: 38 secs
error:pack:1654 - the timing-driven placement phase encountered an error.
mapping completed.
see map report file hdmi_top_map.mrp for details.
problem encountered during the packing phase.
通过添加pll或者删除其中一个clock，尝试了很多次还是报错。在网上找了，找到了类似的情况，但是没有给出解决方案来。
后来尝试添加约束才搞定的。直接指定bufpll的物理位置：
inst hdmi_encoder_0/hdmi_encoder_0/tx_bufpll_inst loc= bufpll_x1y5;
估计原因是：bufpll和oserdes因为不在一个bank下导致无法进行mapping。
图1. 使用osereds的原理图
ref
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工具用的是ise12.2
通过ise自带的clock_wizard来生成需要的时钟，750m是专门用来做t m d s的io输出时钟，主要端口定义如下：
--clock_gen是通过clock_wizard自动生成的。
clock_gen_inst : clock_gen
port map(
clk_in1 => sys_clk_in,
reset => sys_rst,
locked => locked,
clk_out1 => pix_clkx10_pll, --750m, need bufpll as buffer
clk_out2 => pix_clk_pll, --75m
clk_out3 => pix_clkx2_pll, --150m
clk_out4 => sys_clk， --93.75m
clk_out5 => external_clk_buf );
而pix_clkx10_pll必须添加bufpll，bufpll定义如下；
bufpll #(
.divide(5)
)
tx_bufpll_inst(
.ioclk(tx_clkx10),
.locked(locked),
.lock(lock),
.pllin(pix_clkx10),
.gclk(pix_clkx2),
.serdesstrobe(tx_serdesstrobe));
原理图见图1.
按照上面的时钟定义在mapping的时候出现这样的error：
ror:place - constraintresolved no placeable site for u2/tx_bufpll_inst
error:place - sio has over-constrained componet u2/tx_bufpll_inst to have to placeable sites. constraints come from
driver constraints and load io constraints
phase 4.2 initial placement for architecture specific features (checksum:fc8413ca) real time: 38 secs
total real time to placer completion: 38 secs
total cpu time to placer completion: 38 secs
error:pack:1654 - the timing-driven placement phase encountered an error.
mapping completed.
see map report file hdmi_top_map.mrp for details.
problem encountered during the packing phase.
通过添加pll或者删除其中一个clock，尝试了很多次还是报错。在网上找了，找到了类似的情况，但是没有给出解决方案来。
后来尝试添加约束才搞定的。直接指定bufpll的物理位置：
inst hdmi_encoder_0/hdmi_encoder_0/tx_bufpll_inst loc= bufpll_x1y5;
估计原因是：bufpll和oserdes因为不在一个bank下导致无法进行mapping。
图1. 使用osereds的原理图
ref
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