D触发器变体来了，速看！
什么是dre触发器？ff_dre是一个具有异步设置（set)和重置(rst)输入的边缘触发的d触发器（d flip-flop）
在任意时刻，当set或rst为true时会忽略clk信号而设置或重置q信号，rst比set具有优先权，即rst和set同为true时，q被重置为0。
时间图如下：
特征表如下：
其中： clk：时钟， rst：重置， set: 设置 , d：输入 , q：输出
假设最初 输入都为0，输出 q = 0；在t1处，rst=set=0，d=1 ，输出q=1；在t2处，rst=set=0，d=1 ，输出q=1；在t3处，rst=set=0，d=0 ，输出q=0；在t4处，rst=set=0，d=1 ，输出q=1；在t5处，rst=1 ，尽管d=1，但输出q=0；在t6处，rst=0，set=1，输出q=1；在t7处，rst=set=1，rst具有优先权，输出q=0；在t8处，rst=1，尽管clk上升沿，但输出q=0；
源代码如下：
function_block ff_dretitle = 'ff_dre'{ s7_optimized_access := 'true' }version : 0.1 var_input set : bool; d : bool; clk : bool; rst : bool; end_var var_output q : bool; end_var var edge : bool; end_varbeginif #rst or #set then #q := not #rst;elsif #clk and not #edge then #q := #d;end_if;#edge := #clk;end_function_block
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