4位并行的BCD加法器电路图
图二所示为4位并行的bcd加法器电路。其中上面加法器的输入来自低一级的bcd数字。下面加法器bcd的输出e3、e2、e1、e0和cout至高一级 bcd数字,其a3和a1位接地,即当bcd校验信号为真时y=1,a3a2a1a0= 0110,以实现加6的调整.当不需要bcd调整时y=0,此时a3a2a1a0=0000,从而使输出结果无变化.
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