STM32_ADC采样时间_采样周期_采样频率计算方法分析
因项目需要使用到stm32的adc功能，虽然对adc的使用并不陌生，但是第一接触stm32的adc功能还是有种无从下手的感觉，主要是因为stm32adc设计较为复杂，一时对相关的专业术语较为生疏，此外固件库中涉及到的函数虽都进行了分门别类但是还是感觉函数较多，难以很快掌握，现就将个人理解写出，以便大家共同进步。
一、stm32 adc特点 认识事物首先还是要从整体上把握，adc也一样的道理，stm32的adc外设提供了非常完善的功能，虽然其中很大一部分不见得能在项目中使用，但加深对其的认识对于合理利用其资源也是非常有必要的。
下面以项目采用的stm32l151为例，其他类型大同小异。
先看原文：
• 12-bit， 10-bit， 8-bit or 6-bit configurable resolution
• interrupt generation at the end of regular conversions， end of injected conversions， and in case of analog watchdog or overrun events （for regular conversions）
//在规则转换结束、注入转换结束以及模拟看门狗溢出和overrun事件（规则转换模式）发生时能产生中断
• single and continuous conversion modes //有单次和连续转换模式
• scan mode for automatic conversions in a fully programmable order //在自动转换中支持完成可编程的扫描模式
• programmable data alignment with in-built data coherency //数据对齐方式可编程
• programmable and individual sampling time for each adc channel //可以为每个通道设置独立的采样时间
• external trigger option with configurable edge detection for both regular and injected
conversions //外部触发模式对规则和注入转换模式均支持可配置的边沿触发方式
• discontinuous mode //非连续模式
• adc conversion time： 1 μs at full speed （adc clocked at 16 mhz） down to 4 μs at low speed （adc clocked at 4 mhz）， independent of the apb clock//最低采样时间
• automatic power-up/power-down to reduce the power consumption//自动的上下电便于节能
• adc supply requirements：
– 2.4 v to 3.6 v at full speed or with reference zooming （vref+ 《 vdda）
– down to 1.8 v at slower speeds //工作电压范围
• adc input range： vref– ≤ vin ≤ vref+
• automatic programmable hardware delay insertion between conversions
• dma request generation during regular channel conversion //规则转换支持dma
从官方的描述中可以了解到stm32adc所提供的强大功能，及一些工作特性，那么如何才能使用这些功能呢？
adc转换就是输入模拟的信号量，单片机转换成数字量。读取数字量必须等转换完成后，完成一个通道的读取叫做采样周期。采样周期一般来说=转换时间+读取时间
转换时间=采样时间+12.5个时钟周期。采样时间是你通过寄存器告诉stm32采样模拟量的时间，设置越长越精确。
二、stm32 adc采样频率时间、周期、计算方法分析 1. ：先看一些资料，确定一下adc的时钟：
（1），由时钟控制器提供的adcclk时钟和pclk2（apb2时钟）同步。clk控制器为adc时钟提供一个专用的可编程预分频器。
（2） 一般情况下在程序 中将 pclk2 时钟设为 与系统时钟 相同
/* hclk = sysclk */
rcc_hclkconfig（rcc_sysclk_div1）;
/* pclk2 = hclk */
rcc_pclk2config（rcc_hclk_div1）;
/* pclk1 = hclk/2 */
rcc_pclk1config（rcc_hclk_div2）;
（3）在时钟配置寄存器（rcc_cfgr） 中 有 为adc时钟提供一个专用的可编程预分器
位15:14 adcpre：adc预分频
由软件设置来确定adc时钟频率
00：pclk2 2分频后作为adc时钟
01：pclk2 4分频后作为adc时钟
10：pclk2 6分频后作为adc时钟
11：pclk2 8分频后作为adc时钟
我们可对其进行设置 例如：
/* adcclk = pclk2/4 */
rcc_adcclkconfig（rcc_pclk2_div4）;
另外 还有 adc 时钟使能设置
/* enable adc1， adc2 and gpioc clock */
rcc_apb2periphclockcmd（rcc_apb2periph_adc1 | rcc_apb2periph_adc2 |
rcc_apb2periph_gpioc， enable）;
（4）16.7 可编程的通道采样时间
adc 使用若干个adc_clk 周期对输入电压采样，采样周期数目可以通过adc_smpr1和adc_smpr2寄存器中的smp［2:0］位而更改。每个通道可以以不同的时间采样。
总转换时间如下计算：
tconv（转换时间） = 采样时间+ 12.5 个周期
例如：
当adcclk=14mhz 和 1.5周期的采样时间：
tconv = 1.5 + 12.5 = 14周期= 1μs
smpx［2:0］：选择通道x的采样时间
这些位用于独立地选择每个通道的采样时间。在采样周期中通道选择位必须保持不变。
000：1.5周期100：41.5周期
001：7.5周期101：55.5周期
010：13.5周期110：71.5周期
011：28.5周期111：239.5周期
注：
– adc1的模拟输入通道16和通道17在芯片内部分别连到了温度传感器和vrefint。
– adc2的模拟输入通道16和通道17在芯片内部连到了vss。
2. 具体分析如下：
（1）我们的输入信号是50hz （周期为20ms），初步定为1周期200个采样点，（注：一周期最少采20个点，即采样率最少为1k） ，每2个 采样点间隔为 20ms /200 = 100 us
adc可编程的通道采样时间 我们选最小的 1.5 周期，则 adc采样周期一周期大小为
100us /1.5=66us 。 adc 时钟频率为 1/66us =15 khz。
adc可编程的通道采样时间 我们选71.5 周期，则 adc采样周期一周期大小为
（100us /71.5） 。 adc 时钟频率为 7.15mhz。
（2）接下来我们要确定系统时钟：我们 用的是 8m hz 的外部晶振做时钟源（hse），估计得 经过 pll倍频 pll 倍频系数分别为2的整数倍，最大72 mhz。为了 提高数据 计算效率，我们把系统时钟定为72mhz，（pll 9倍频）。则pclk2=72mhz，pclk1=36mhz;
我们通过设置时钟配置寄存器（rcc_cfgr） 中 有 为adc时钟提供一个专用的可编程预分器，将pclk2 8 分频后作为adc 的时钟，则可知adc 时钟频率为 9mhz
从手册可知： adc 转换时间：
stm32f103xx增强型产品：adc时钟为56mhz时为1μs（adc时钟为72mhz为1.17μs）
（3）由以上分析可知：不太对应，我们重新对以上中 内容调整，提出如下两套方案：
方案一：我们的输入信号是50hz （周期为20ms），初步定为1周期2500个采样点，（注：一周期最少采20个点，即采样率最少为1k） ，每2个 采样点间隔为 20ms /2500 = 8 us
adc可编程的通道采样时间 我们选71.5周期，则 adc采样周期一周期大小为
8us /71.5 。 adc时钟频率约为 9 mhz。
将pclk2 8 分频后作为adc 的时钟，则可知adc 时钟频率为 9mhz
方案二：我们的输入信号是50hz （周期为20ms），初步定为1周期1000个采样点，（注：一周期最少采20个点，即采样率最少为1k） ，每2个 采样点间隔为 20ms /1000= 20 us
adc可编程的通道采样时间 我们选239.5周期，则 adc采样周期一周期大小为
20us /239.5 。 adc时钟频率约为 12 mhz。
将pclk2 6 分频后作为adc 的时钟，则可知adc 时钟频率为 12mhz
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• 12-bit， 10-bit， 8-bit or 6-bit configurable resolution
• interrupt generation at the end of regular conversions， end of injected conversions， and in case of analog watchdog or overrun events （for regular conversions）
//在规则转换结束、注入转换结束以及模拟看门狗溢出和overrun事件（规则转换模式）发生时能产生中断
• single and continuous conversion modes //有单次和连续转换模式
• scan mode for automatic conversions in a fully programmable order //在自动转换中支持完成可编程的扫描模式
• programmable data alignment with in-built data coherency //数据对齐方式可编程
• programmable and individual sampling time for each adc channel //可以为每个通道设置独立的采样时间
• external trigger option with configurable edge detection for both regular and injected
conversions //外部触发模式对规则和注入转换模式均支持可配置的边沿触发方式
• discontinuous mode //非连续模式
• adc conversion time： 1 μs at full speed （adc clocked at 16 mhz） down to 4 μs at low speed （adc clocked at 4 mhz）， independent of the apb clock//最低采样时间
• automatic power-up/power-down to reduce the power consumption//自动的上下电便于节能
• adc supply requirements：
– 2.4 v to 3.6 v at full speed or with reference zooming （vref+ 《 vdda）
– down to 1.8 v at slower speeds //工作电压范围
• adc input range： vref– ≤ vin ≤ vref+
• automatic programmable hardware delay insertion between conversions
• dma request generation during regular channel conversion //规则转换支持dma
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adc转换就是输入模拟的信号量，单片机转换成数字量。读取数字量必须等转换完成后，完成一个通道的读取叫做采样周期。采样周期一般来说=转换时间+读取时间
转换时间=采样时间+12.5个时钟周期。采样时间是你通过寄存器告诉stm32采样模拟量的时间，设置越长越精确。
二、stm32 adc采样频率时间、周期、计算方法分析 1. ：先看一些资料，确定一下adc的时钟：
（1），由时钟控制器提供的adcclk时钟和pclk2（apb2时钟）同步。clk控制器为adc时钟提供一个专用的可编程预分频器。
（2） 一般情况下在程序 中将 pclk2 时钟设为 与系统时钟 相同
/* hclk = sysclk */
rcc_hclkconfig（rcc_sysclk_div1）;
/* pclk2 = hclk */
rcc_pclk2config（rcc_hclk_div1）;
/* pclk1 = hclk/2 */
rcc_pclk1config（rcc_hclk_div2）;
（3）在时钟配置寄存器（rcc_cfgr） 中 有 为adc时钟提供一个专用的可编程预分器
位15:14 adcpre：adc预分频
由软件设置来确定adc时钟频率
00：pclk2 2分频后作为adc时钟
01：pclk2 4分频后作为adc时钟
10：pclk2 6分频后作为adc时钟
11：pclk2 8分频后作为adc时钟
我们可对其进行设置 例如：
/* adcclk = pclk2/4 */
rcc_adcclkconfig（rcc_pclk2_div4）;
另外 还有 adc 时钟使能设置
/* enable adc1， adc2 and gpioc clock */
rcc_apb2periphclockcmd（rcc_apb2periph_adc1 | rcc_apb2periph_adc2 |
rcc_apb2periph_gpioc， enable）;
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adc 使用若干个adc_clk 周期对输入电压采样，采样周期数目可以通过adc_smpr1和adc_smpr2寄存器中的smp［2:0］位而更改。每个通道可以以不同的时间采样。
总转换时间如下计算：
tconv（转换时间） = 采样时间+ 12.5 个周期
例如：
当adcclk=14mhz 和 1.5周期的采样时间：
tconv = 1.5 + 12.5 = 14周期= 1μs
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这些位用于独立地选择每个通道的采样时间。在采样周期中通道选择位必须保持不变。
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001：7.5周期101：55.5周期
010：13.5周期110：71.5周期
011：28.5周期111：239.5周期
注：
– adc1的模拟输入通道16和通道17在芯片内部分别连到了温度传感器和vrefint。
– adc2的模拟输入通道16和通道17在芯片内部连到了vss。
2. 具体分析如下：
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100us /1.5=66us 。 adc 时钟频率为 1/66us =15 khz。
adc可编程的通道采样时间 我们选71.5 周期，则 adc采样周期一周期大小为
（100us /71.5） 。 adc 时钟频率为 7.15mhz。
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方案一：我们的输入信号是50hz （周期为20ms），初步定为1周期2500个采样点，（注：一周期最少采20个点，即采样率最少为1k） ，每2个 采样点间隔为 20ms /2500 = 8 us
adc可编程的通道采样时间 我们选71.5周期，则 adc采样周期一周期大小为
8us /71.5 。 adc时钟频率约为 9 mhz。
将pclk2 8 分频后作为adc 的时钟，则可知adc 时钟频率为 9mhz
方案二：我们的输入信号是50hz （周期为20ms），初步定为1周期1000个采样点，（注：一周期最少采20个点，即采样率最少为1k） ，每2个 采样点间隔为 20ms /1000= 20 us
adc可编程的通道采样时间 我们选239.5周期，则 adc采样周期一周期大小为
20us /239.5 。 adc时钟频率约为 12 mhz。
将pclk2 6 分频后作为adc 的时钟，则可知adc 时钟频率为 12mhz
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