下一代内存技术：准备好迎接验证挑战了吗
内存技术的进步以及对更快、更高密度配置的需求使验证工程师陷入困境。内存世界正在讨论下一波内存协议和技术，如下一代ddr，hbm和nvdimm：
复员方案：希望下一代ddr规范将为计算机带来许多好处。随着更快、更密集的内存应用，虚拟现实等应用最终将比以往任何时候都更接近现实。synopsys 继续积极与 jedec 标准委员会和内存供应商合作，为客户提供尽可能接近最终标准的下一代 ddr vip 的早期体验。
hbm：又名高带宽内存是一种新型内存，它采用垂直堆叠技术配置，功耗低，是超宽通信通道的推动者。这项技术的美妙之处在于它占用的平面图占地面积。与 gddr5 相比，hbm 可以在 94% 的空间内容纳相同数量的内存！此内存 vip 目前包含在 synopsys vip 产品组合中。
nvdimm：又名非易失性双列直插式内存模块。这是一个ram dimm，在电源关闭时不会丢失其数据。这两种强大技术的结合为提高应用程序性能、数据安全性和系统崩溃恢复时间提供了一系列好处。synopsys 正在与内存供应商密切合作，以捕获要包含在 nvdimm vip 中的技术的最终细节。
下一代内存 vip 架构
这些存储器类型中的每一种都需要自己的协议定义以及自己的时序和电源特性。需求的涌入给验证工程师带来了一场噩梦，他们的工作是为需要这些不同内存技术的 dut 创建验证环境。许多挑战潜伏在幕后。其中一些挑战，但不限于此，是：
将验证模型配置为特定 jedec 配置或特定供应商部件，通常情况下，一旦模型加载到仿真中，vip 就不允许配置更新。
制定涵盖所有时间和协议排列的保险计划
使用熟悉的协议感知调试环境。否则，必须创建不同的调试技术，并根据所使用的内存类型进行定制。
内存验证计划：协议规范到验证闭合
使用 synopsys 验证 ip 产品组合中的内存 vip 可以缓解上述担忧和挑战。让我推断一下：
对于不同的 jedec 配置，对于 jedec 允许的时序可能性的每个排列，都不需要配置文件。使用内存 vip 虚拟部件选择指定所需的配置参数，vip 会根据这些参数自动创建配置对象。虚拟部件选择的详细信息将在后续博客中介绍。
vip带有自己的特定于协议的保险计划。在打开覆盖范围选项的情况下启动 verdi，加载计划，然后让工具将结果注释到计划中进行分析。
使用 verdi 作为具有本机协议感知功能的统一调试平台。并利用该功能在信号和交易之间同步。这种方法隐藏了前门驱动操作的低水平细节。
内存技术的进步以及对更快、更高密度配置的需求使验证工程师陷入困境。内存世界正在讨论下一波内存协议和技术，如下一代ddr，hbm和nvdimm：
复员方案：希望下一代ddr规范将为计算机带来许多好处。随着更快、更密集的内存应用，虚拟现实等应用最终将比以往任何时候都更接近现实。synopsys 继续积极与 jedec 标准委员会和内存供应商合作，为客户提供尽可能接近最终标准的下一代 ddr vip 的早期体验。
hbm：又名高带宽内存是一种新型内存，它采用垂直堆叠技术配置，功耗低，是超宽通信通道的推动者。这项技术的美妙之处在于它占用的平面图占地面积。与 gddr5 相比，hbm 可以在 94% 的空间内容纳相同数量的内存！此内存 vip 目前包含在 synopsys vip 产品组合中。
nvdimm：又名非易失性双列直插式内存模块。这是一个ram dimm，在电源关闭时不会丢失其数据。这两种强大技术的结合为提高应用程序性能、数据安全性和系统崩溃恢复时间提供了一系列好处。synopsys 正在与内存供应商密切合作，以捕获要包含在 nvdimm vip 中的技术的最终细节。
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这些存储器类型中的每一种都需要自己的协议定义以及自己的时序和电源特性。需求的涌入给验证工程师带来了一场噩梦，他们的工作是为需要这些不同内存技术的 dut 创建验证环境。许多挑战潜伏在幕后。其中一些挑战，但不限于此，是：
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hbm：又名高带宽内存是一种新型内存，它采用垂直堆叠技术配置，功耗低，是超宽通信通道的推动者。这项技术的美妙之处在于它占用的平面图占地面积。与 gddr5 相比，hbm 可以在 94% 的空间内容纳相同数量的内存！此内存 vip 目前包含在 synopsys vip 产品组合中。
nvdimm：又名非易失性双列直插式内存模块。这是一个ram dimm，在电源关闭时不会丢失其数据。这两种强大技术的结合为提高应用程序性能、数据安全性和系统崩溃恢复时间提供了一系列好处。synopsys 正在与内存供应商密切合作，以捕获要包含在 nvdimm vip 中的技术的最终细节。
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这些存储器类型中的每一种都需要自己的协议定义以及自己的时序和电源特性。需求的涌入给验证工程师带来了一场噩梦，他们的工作是为需要这些不同内存技术的 dut 创建验证环境。许多挑战潜伏在幕后。其中一些挑战，但不限于此，是：
将验证模型配置为特定 jedec 配置或特定供应商部件，通常情况下，一旦模型加载到仿真中，vip 就不允许配置更新。
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