在NI VeriStand环境中进行FPGA相关配置
本文主要介绍了用户如何在ni veristand环境中进行基于fpga的相关配置。并以使用7851r输出pwm波为例，叙述了在veristand 2011运行环境中所需要的所有工作。
ni veristand是一个基于配置的实时测试软件，它拥有与labview类似的前面板，但无需任何编程工作。用户可以使用labview、matlab等其他软件生成的模型文件导入veristand，方便快捷的实现硬件在环等实时测试应用。
在veristand系统浏览器中，可以对ni的硬件设备实现参数配置。参考kb：如何在veristand中实现daq卡计数器输出的功能？
与配置采集卡相比，对fpga设备的配置流程会有所不同。接下来我们就以使用pcie-7851r输出pwm波为例，叙述具体的配置流程。
ni veristand fpga i/o接口工具 1) 下载并安装ni veristand fpga i/o接口工具
该接口工具提供了实现fpga自定义i/o的labview模板程序。
2) 安装完成后，在windows的共享文件夹下找到fpga i/o特性的labview模板。在win7系统中，该模板位于c:\users\public\documents\national instruments\ni veristand 2011\fpga\templates
这里我们选择ni veristand fpga io pxi-7831r模板项目。打开模板，我们会惊喜的发现，它已经为我们定义好了定时、触发、aio、dio、pwm、dma读写这些常用的功能接口。
这里简单的对模板中pwm功能做一个说明：
1. 从8个数字口中读取pwm波，并分析出高电平与低电平的持续时间(以40mhz时钟滴答为单位)。
2. 将得到的高电平与低电平持续时间通过fifo传输，控制另8个数字口的pwm波输出。
3) 由于这里我们希望通过在veristand中设置相应的高低电平时间来改变pwm波的占空比，因此对模板做以下修改，将反馈节点的输出断开。运行程序，生成fpga比特文件。
fpga 配置文件 现在我们已经有了fpga的比特文件了，如何在veristand中实现对该比特文件的部署呢？在veristand中，xml格式的fpga配置文件充当了这样一个比特文件“解读器”的角色。要自己创建一个配置文件不是一个简单的事情，但可以直接打开已有的一些配置，进行修改。这些配置文件存放路径为：c:\users\public\documents\national instruments\ni veristand 2011\fpga\
打开pcie-7851r analog, pwm, digital ports，可以看到一个fpga的配置文件大体结构为：
配置文件中各标签的含义，可以参考
仍在该路径下，将该配置文件另存一下，如改名pwm out。将pxi-7851r.lvbitx改为之前生成的比特文件的名字。并将比特文件复制到该路径下。
在标签下找到pwm out 0，并为其添加两个参数来设定高低电平持续时间：
需要注意的是，中的名字一定要与fpga中相应控件的名字相同。这里使用的初始值为1000， (1/40m)*1000=25us，即pwm初始的设置为周期50us，占空比0.5。
veristand系统配置 经过之前一系列的准备工作，我们终于可以在veristand对fpga进行配置运行了。
进入veristand系统浏览器，在fpga目标中导入配置文件。
选中pwm out 0，在右边的配置页面中可以看到我们添加的两个参数low pulse和high pulse，设置好我们需要的值，就可以在项目浏览器中运行测试了。
至此我们已经完成了veristand基于fpga i/o的调用。遗憾的是，通过这种方法并不能在测试运行时实时的改变参数，好在大多数pwm应用都会做成闭环控制。
veristand可以通过自定义设备(custom device)实现更加灵活的i/o配置，但同样，实现方式也更加复杂。
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ni veristand fpga i/o接口工具 1) 下载并安装ni veristand fpga i/o接口工具
该接口工具提供了实现fpga自定义i/o的labview模板程序。
2) 安装完成后，在windows的共享文件夹下找到fpga i/o特性的labview模板。在win7系统中，该模板位于c:\users\public\documents\national instruments\ni veristand 2011\fpga\templates
这里我们选择ni veristand fpga io pxi-7831r模板项目。打开模板，我们会惊喜的发现，它已经为我们定义好了定时、触发、aio、dio、pwm、dma读写这些常用的功能接口。
这里简单的对模板中pwm功能做一个说明：
1. 从8个数字口中读取pwm波，并分析出高电平与低电平的持续时间(以40mhz时钟滴答为单位)。
2. 将得到的高电平与低电平持续时间通过fifo传输，控制另8个数字口的pwm波输出。
3) 由于这里我们希望通过在veristand中设置相应的高低电平时间来改变pwm波的占空比，因此对模板做以下修改，将反馈节点的输出断开。运行程序，生成fpga比特文件。
fpga 配置文件 现在我们已经有了fpga的比特文件了，如何在veristand中实现对该比特文件的部署呢？在veristand中，xml格式的fpga配置文件充当了这样一个比特文件“解读器”的角色。要自己创建一个配置文件不是一个简单的事情，但可以直接打开已有的一些配置，进行修改。这些配置文件存放路径为：c:\users\public\documents\national instruments\ni veristand 2011\fpga\
打开pcie-7851r analog, pwm, digital ports，可以看到一个fpga的配置文件大体结构为：
配置文件中各标签的含义，可以参考
仍在该路径下，将该配置文件另存一下，如改名pwm out。将pxi-7851r.lvbitx改为之前生成的比特文件的名字。并将比特文件复制到该路径下。
在标签下找到pwm out 0，并为其添加两个参数来设定高低电平持续时间：
需要注意的是，中的名字一定要与fpga中相应控件的名字相同。这里使用的初始值为1000， (1/40m)*1000=25us，即pwm初始的设置为周期50us，占空比0.5。
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选中pwm out 0，在右边的配置页面中可以看到我们添加的两个参数low pulse和high pulse，设置好我们需要的值，就可以在项目浏览器中运行测试了。
至此我们已经完成了veristand基于fpga i/o的调用。遗憾的是，通过这种方法并不能在测试运行时实时的改变参数，好在大多数pwm应用都会做成闭环控制。
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