一种基于EBR的数据延时的实现方法
数据延时线（delay line）在数字信号处理中具有广泛的应用，例如fir滤波器设计中就会需要用到数据延时线。实际上，在绝大部分的pipeline设计中都会需要用到数据延时。本文介绍一种基于ebr（embedded block ram，xilinx叫做bram，altera叫做embedded memory）的数据延时的实现方法。
如下图所示：
将ebr配置为单端口的ram（即ram_dq），其中，write mode配置为read before write。即同时对同一地址进行读写操作时，将首先读取出改地址空间的原有数据，然后在将新的数据写入到该地址空间中。如下图所示：
此模式下的波形图为：
假定计数器模为4，并将we信号接高电平，ram的初始值为0，则相应的时序图如下图所示：
在第一帧地址内，从0号地址读出的数据为0，再将数据a写入0号地址中，从1号地址读出的数据为0，再将数据b写入1号地址。类似的，数据c和数据d分别被写入到2号地址和3号地址中。在第二帧地址内，从0号地址读取出的数据即为在第一帧地址内写入的数据a，类似的，从1~3号地址中读出的数据分别为b，c和d。由于我们使能了输出寄存器，所以从输入端din到输出端dout一共有5级时钟周期的latency。
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此模式下的波形图为：
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