EDA系统框架结构是怎么样的？标准化现状如何？
设计工具产生的数据格式的一致性对设计结果的交换和共享极为重要，数据格式的一致性通过标准保证，对的底层技术、软件之间的接口以及数据格式等标准的发展情况进行了综述和分析。我国在世界集成电路设计占有越来越举足轻重的作用，eda技术的标准化刻不容缓，eda技术的国际标准化以及国内标准化必将大大促进我国集成电路行业的发展。
电子设计技术的核心是eda（electronic design automation，电子设计自动化）技术，eda是指以计算机为工作平台，融合电子技术、计算机技术、智能化技术等研制成的电子cad通用软件包，主要辅助进行ic设计、电子电路设计和pcb设计等。eda技术已有30多年的发展历程，大致可分为20世纪70年代的计算机辅助设计（cad）阶段、80年代的计算机辅助工程（cae）阶段和90年代后的电子系统设计自动化（eda）阶段，其功能越来越强大，相应对标准化的要求也越来越高。
随着半导体工艺的进步，集成电路设计环境出现了工艺技术进步速度大于eda工具进步的现象。面对超大规模asic的设计，业界有两种倾向：一是提高设计的抽象层次，降低设计的复杂度，这主要由eda工具的发展来带动，较显著的是行为级综合工具的出现;二是提高设计的粒度，采用可复用的ip核，进行系统的集成。这都引发了eda工具和eda设计过程、设计结果新的标准化问题。
目前，eda工具众多，在给予设计者众多选择的同时，也会导致设计平台失去一致性，阻碍了设计结果的数据交换和共享，这也成为集成电路和eda工具发展的障碍。芯片复杂程度越高，对eda的依赖也越高，如果缺乏eda的底层技术及其接口的标准化，就不能很好地对涉及结果进行交换、共享及重用。
1 eda设计平台标准 广泛应用于eda的设计平台主要有两个：一是运行在各类unix系统下的桌面高端服务器型工程工作站;二是运行在各类微软windows操作系统下的桌面型pc机。复杂的芯片设计多采用unix工作站完成，而基于windows系统的pc机多用来完成pcb设计、fpga和可编程ic设计和一些底端的asic设计（用于设计过程中的所选择的一部分）。较流行的eda软件平台是unix工作站，其中受欢迎的计算环境主要包括：sunsoft的sun操作系统（正在过渡到solaris更新的版本），hewlett packard hp-ux，ibmaix，decosf/1等。由于windows平台的易用性，它越来越受到设计者的青睐。
iec/tc93的eda标准路线图专题研究组下的eii（eda互操作和集成）小组认为对cde（通用桌面工作环境）中的用户界面，windows和macintosh之间已经有足够的一致性，这个方面已不存在尚未解决的重要问题，计算环境和用户界面的标准推荐采用unix平台上的cde环境以及windows平台上的windows图形用户界面。
2 硬件描述语言及接口标准 2.1 硬件描述语言标准 硬件描述语言（hardware description language，hdl）用软件编程的方式来描述电子系统的逻辑功能、电路结构和连接形式。目前典型的硬件描述语言有vhdl，verilog，systemc等。美国硅谷较流行使用veriloghdl，而欧洲则较多使用vhdl。另外还有ahdl，用c/c++作为系统级设计语言则是一个新兴的方法，superlog，cynlibc++等新的硬件描述语言随着系统级fpga以及soc的发展、软硬件协调设计和系统设计的需求也发展了起来。
早期的硬件描述语言，如abel，hdl，ahdl，由不同的eda厂商开发，互不兼容，而且不支持多层次设计，层次间翻译工作要由人工完成，效率低下且容易出错。为了克服以上不足，1985年美国国防部正式推出了高速集成电路硬件描述语言vhdl，1987年ieee采纳vhdl为硬件描述语言标准（ieee1076-1987），第二个版本是在1993年制定的（vhdl-93）。vhdl同时也是军事标准（454）和ansi标准。作为一种硬件描述语言标准，vhdl为众多的eda厂商支持，且移植性好。
veriloghdl的使用也非常普遍，其对电路控制的灵活性方面它的效率比vhdl要高。在美国、日本等国verilog语言的使用率要远高于其他语言。veriloghdl在1995年成为ieee标准（ieee13641995），2001年发布了ieee1364-2001，目前正在进行新的修订（ieee1364-2005）。由于accellera标准组织决定将systemverilog3.1a（systemverilog是veriloghdl系统级扩展版）捐献给新的ieee工作组，而不是原先负责verilog标准化的ieee1364工作组，因此可能会导致两个verilog标准化工作，即ieee1364-2005和ieee1800，这也许会影响verilog语言的标准化，破坏该语言的统一性。 systemverilog于2004年获得了par（project authorization request，项目授权请求）编号，由ieee开展的标准化活动已经开始。据accellera会长丹尼斯·布罗菲（dennisb.brophy）介绍，systemverilog预计将在2005年内成为取消“p”字的ieee正式标准。
作为两大标准的硬件描述语言，vhdl和veriloghdl的互操作性非常重要，曾经vhdl和verilog的相应的国际组织vi（vhdl国际组织）、ovi（open verilog international，开放verilog国际组织，1999年成立）努力协调vhdl和verilog的互操作问题。2000年，vi和ovi这两个拥有丰富标准制定程序经验的组织合并成立了accellera。accellera正在进行assertion属性描述语言“psl”的标准化工作———ieee1850，pls预计也像systemverilog一样在2005年内成为ieee标准。
2.2 硬件描述语言与设计分析工具的接口标准 详细设计阶段包括面向给定工艺的详细逻辑设计（rtl描述）和物理设计（版图设计）。逻辑设计阶段创建和分析详细的逻辑，进行设计功能仿真、时序验证、可靠性分析以及给定逻辑的预布局及散热分析、功耗估计。物理设计是在版图设计规则和各种约束条件的指导下，设计的逻辑描述被物理综合为具体的版图数据，对整个版图的各种规则、寄生效应和时序进行分析（跨越设计层次、分层次互连模型、分层次寄生参数提取和建模的精确时序分析），对设计的质量和可靠性进行分析和度量（信号质量分析、能量网格分析、散热分析、功耗分析）。
在这方面，有许多国际标准和事实标准在使用，包括edif（electronicdesigninterchangeformat，电子设计交换格式，edif4.0.0现在已经成为eda标准，许多eda开发商如mentor，candence等都已采用。edif4.0.0实际上是eda建模的新方法，为一种语言描述形式），cfidr，pdef，def，spf，sdf等。edif，cfidr和pdes（stepap210）都不同程度地处理逻辑设计和物理设计的结果。但是，目前还没有适当的标准能够类似edif的处理途径以一致的方式用于逻辑连接，以支持基于文件的数据;也没有适当的标准能够以一致的方式用于类似dr处理途径的编程接口。对于芯片的物理设计数据也没有标准，虽然edifpcb/mcm被mcmasem联盟选作mcm物理设计数据的标准，但用于mcm物理设计数据的标准需要在edif中继续完善。cfi（cadframeworkinitiative，cad系统框架委员会，1988年在美国成立）组织正在通过edif汇聚成标准信息模型（最终通过pdes汇聚成通用的信息模型）。
2.3 逻辑连接标准 开发通用核心信息模型主要目的之一是处理逻辑互连，所有与逻辑互连有关的详细设计工业标准都应该是这个信息模型的一部分，这样，各种各样的工业信息模型就可以从这个标准而来。
当前业界使用的相关标准有edif，pcm/mcm，cfidr等。edif综合了多种格式中的最佳特性，1985年的edif1.0.0版本提供了门阵列、半导体集成电路设计和布线自动化交换信息的格式，而后的edif2.0.0版本是不同eda厂家之间交换设计数据的标准格式，edif4.0.0由eia（electronic industries association，电子工业协会）发布为标准，edif4.0.0成员大多是世界上著名的eda供应商及一些电子行业有影响力的协会等，主要由eia，ipc，曼彻斯特大学（universityof manchester），mentor graphics，solectron和hadco santa clara等机构与组织组成。cfi解决的是不同eda厂家工具集成和实时通信问题，edif格式解决的是用不同eda厂家工具完成设计的数据交流问题。
2.4 测试矢量标准 测试矢量标准既有许多正规的国际标准，又有许多事实上的标准，正规的标准包括waves（ieee1029.1），dtif（ieee1029.4）以及新的dasc协议。事实标准如summtdesign，teardyne，许多公司也建立了自己的内部格式标准。测试矢量规范的标准需要解决数字测试矢量如何从一种格式转换为另一种格式的问题。
3 eda系统框架结构 eda系统框架结构（framework）是一套配置和使用eda软件包的规范。目前主要的eda系统都建立了框架结构，如cadence公司的design framework，mentor公司的falcon framework，这些框架结构都遵守cfi组织制定的统一技术标准。框架结构能将来自不同eda厂商的工具软件进行优化组合，集成在统一环境之下，而且还支持任务之间、设计师之间以及整个产品开发过程中的信息传输与共享，是并行工程和自顶向下设计方法的实现基础。
系统框架为各种eda工具提供一个公用运行操作环境的软件系统，包括程序库、扩展语言版本管理、设计方法和设计流程管理、用户界面等。通过框架，用户可对各种eda工具实施管理，掌握设计执行过程，创建、组织和管理数据。eda系统框架的基本内容包括：数据模型及数据管理、设计方法管理、设计流程管理和用户界面4部分。1993年cfi正式颁布了cfi1.0框架规范和相应的规范遵从审核程序。cfi框架体系标准解决了实时的工具通信、工具嵌入方式和设计描述，使用户能够混合和匹配来自不同eda厂家的工具，构成集成的设计环境。
3.1 eda工具间的通信标准 集成电路设计规模的扩大、公司全球化的发展，要求eda工具提供支持基于网络的地理位置分散的开发环境，各应用工具可以通过信息进行交互，以组成横跨世界范围的网络。通过最大化工具间的通信和协同工作能力来缩短设计周期，而不是连续的文件翻译和整个设计部分的转移。这要求eda设计工具具有较高的独立性，以独立于其他的支持eda的技术如产品数据管理（pdm）技术，各种eda工具能够以特定的方式与pdm系统通信。
tooltalk通信工具（包含在cde中）已被cfi认可作为工具间通信机制标准。然而，仅有通用的通信工具还不够，各种应用工具必须使用消息通用集进行通信。cfi已经开发了一个关于eda消息字典的标准。cfi之所以推荐tooltalk，也与eda消息字典的扩展有关，tooltalk工具能够满足在unix环境类中所有已知的要求。但是，为满足运行在windows环境下与那些运行在unix环境下的工具间进行通信的需求、满足工作环境提供协同工作能力的需求，tooltalk工具还须进一步发展。关于与工具集成，cfi工具封装标准tes是现在这个领域仅有的一个标准，为满足eda行业的需要，tes也在不断发展和完善，目前已发展到可以支持将工具自动封装到cde环境。cif对传输接口（xti）采用x/open标准。
3.2 eda系统的扩展语言标准 扩展语言（extensionlanguage，el）是大多数eda系统和工具集的集成部分，用以给设计者和eda集成工具提供扩展其他工具的功能，流行的扩展语言包括skill，ample，基于设计的扩展语言如cfi扩展语言。另外，各种脚本语言也用于扩展eda系统，例如perl，tktcl。eda扩展语言的多样性导致使用扩展语言实现eda设计功能以及这些功能的维护、移植变得困难和昂贵。目前，由于eda扩展语言还没有统一，eda必须支持多种扩展语言的并存。从长远来看，最终需要一种标准的eda扩展语言，该标准扩展语言的可重复性、可移植性、工艺性良好，易于被设计者和eda集成工具使用。如今，cfi扩展语言在一定程度上已经作为一个标准扩展语言得到了广大eda工具和工具商的支持。perl也很流行，很多eda工具支持经过api访问perl扩展语言库。
扩展语言函数库能够为eda设计系统的对象和设计数据提供访问接口，能够给应用程序开发人员和eda集成工具及用户提供一致的图形用户界面和一系列的应用程序控件，与各种流行的扩展语言包括cfi扩展语言和perl兼容。
3.3 设计对象命名标准 当前很多设计工具可以使用命名惯例给eda设计对象命名。然而，在某些工具供应商的设计工具或系统中，这个名称有很多限制（例如名称的长度或者名称可用的字符集），而且名称对象的命名规则在不同的工具供应商之间、不同的应用系统之间不尽相同，在由不同工具供应商提供的多个应用系统构成的复杂设计环境下，设计对象命名依然存在一些混淆，尤其是当一些使用不同命名惯例的工具用于衔接紧密的设计循环的情况，于是产生了非常复杂的映射问题。为便于兼容与移植，需要新的设计对象命名标准，标准需要支持主要的设计对象命名惯例，并且支持与现有的设计工具的兼容，给出如何与现有命名惯例进行转化，能够通过工具间通信进行名字对象映射。
3.4 时序信息 0.35μm工艺下由于连线引起的延迟已经占到总延迟的80%～90%，系统设计经常需要在早期即把时序设计作为设计的一部分，时序约束已经成为一个关键约束。时序信息在分级和增量的基础上可作为过程接口的形式被加以利用，当前许多时序驱动的设计工具实际上都与标准延迟文件（sdf，是一个包含了大批量时序信息的文件）进行交互。处理sdf文件的工具将整个文件读入并通过分别给出的连接关系或设计的结构数据描述与时序数据进行关联。现存的标准（如edif，cfidr，ap210）还没有正式数据。标准延迟计算语言（dcl）要求时序信息被当前的标准如sdf支持，对于sdf的扩展应加以监控，以使得标准能够包含必要的信息。
4 ip核标准化 随着集成电路规模和复杂性的增大，基于ip复用技术的设计方法成为弥补设计生产效率和芯片密度之间的差距以及快速进入市场最有效的方法。调查显示，1995年掩模和设计的成本只占据整体的13%，而现在这个比例已升高到62%以上，ip在提高设计速度，降低成本中发挥着越来越重要的作用。“至2010年，ip的使用率将超过90%，基于ip的设计策略日益重要”。synopsys的ctoraulcamposano博士表示，“而同时存在的问题是如何解决ip多样性，这就需要建立标准的平台和开放式的数据库”。作为解决措施之一，业界正寻求通过建立ip标准化协会来克服这一棘手的问题。部分公司开始和代工厂合作提供更详细的ip信息，或与eda公司合作提供经过验证的ip，尽管如此，ip的标准化仍然是个很大的问题。在ip核的使用过程中，来自不同厂商的ip集成于同一个芯片中时，会带来很多整合的问题，集成的效果难以达到理想状态。
ip可用性、可复用性、质量评估、建库及ip交易需要统一的标准来支持。国际上关于ip设计、可用性、可复用性及质量评估及其标准化等从20世纪90年代后期开始，交易市场也初步形成。目前，在世界半导体产业的主要国家和地区，都相继建立了ip/soc设计、交易、管理的组织和机构，包括vsia（美国），vcx（英国），d&r（法国），iptc（日本），sipca（韩国），rapid，***soc推动联盟等。这些组织积极进行ip标准化工作，促进了ip产业的发展。ip/soc的标准主要由vsia（virtual socket interface alliance，虚拟插座接口联盟）制定，目前vsia已经发布的ip核复用的各种文件中，包括8个规范、5个标准、4个分类法文件、一个质量度量电子表格软件以及其他几个文件，主要是ip核的复用设计标准、交付使用标准。
虽然ip核标准化取得了一定进展，但ip核的设计及使用仍不尽人意，从标准化的角度来讲，迫切需要解决ip核标准的适应性和可接受性问题。首先，因为ip核标准独立于具体器件、具体公司、具体工具、具体工艺，所以一方面标准的一些属性过于细致，使设计者很难确定合适的值，但另一方面又有一些属性不完备，不能很好地说明器件的特性。其次，目前多数ip核标准仍在试行阶段，标准的推广和用户的认可程度不尽人意。各个设计公司，尤其是大型的成熟公司都有自己的内部标准，行业组织推出的标准很难在这些公司内部推广。再次，目前在设计领域充斥着各种概念和术语，设计人员之间、以及公司之间使用的术语往往不一致，但这些术语的统计、确认以及让设计人员接受和认可这些标准仍需要时间。最后，目前专门用于ip设计的工具仍是空白，大多数设计工具对ip核的设计、ip库的管理和使用无能为力，ip的设计、管理和使用方面的标准化有待发展。
随着超大规模集成电路和系统芯片设计的发展，eda工具制造商正在尽力提高逻辑抽象的层次，eda也向更高级的描述语言和全集成的验证环境、以及如何将模拟功能集成到数字电路中、分层次设计方法和增量处理等方向发展。eda设计、测试、封装等多个环节密不可分，eda标准化范畴很大，本文只粗浅地介绍了其中的部分内容。
eda标准化已经取得了很大进展，但相关标准和亟待发展的标准依然很多，迫切需要eda行业广泛参与并达成一致，代工厂、工具供应商和芯片设计师加强彼此联系与协作。eda产业的发展也产生了新的标准化问题，如代工工艺设计流程套件（pdks）的标准化等。
dfm（可制造性设计）已经出现动向。eda标准化团体美国si2（silicon integrated initiative）和半导体制造设备业界团体semi（semiconductor equipmentand materials institute，导体设备暨材料协会）已经展开合作，开始建立“designto manu facturing coalition（设计与制造的统一）”的dfm应用标准化平台，semi的数据模型“universal data model（udm，通用数据模型）”和open access正逐渐成为事实标准。si2制定的“lef（library exchange format），def（design exchange format）”也在成为更加完善的工业技术标准。此外，si2也正致力于ip有关的标准化工作。
无论是eda的使用还是eda工具本身，我国与先进国家相比都有很大差距。eda标准化工作在我国刚刚起步，我国有庞大的市场需求和高的增长速度，同时还有后发优势，这是我国eda发展的楔机。在eda标准化方面，目前主要应采用国际和国外先进标准，一方面引进和转化适用的标准，更重要的是加强转化后标准的宣传和推广，通过标准化工作促进我国eda及集成电路产业的发展。
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电子设计技术的核心是eda（electronic design automation，电子设计自动化）技术，eda是指以计算机为工作平台，融合电子技术、计算机技术、智能化技术等研制成的电子cad通用软件包，主要辅助进行ic设计、电子电路设计和pcb设计等。eda技术已有30多年的发展历程，大致可分为20世纪70年代的计算机辅助设计（cad）阶段、80年代的计算机辅助工程（cae）阶段和90年代后的电子系统设计自动化（eda）阶段，其功能越来越强大，相应对标准化的要求也越来越高。
随着半导体工艺的进步，集成电路设计环境出现了工艺技术进步速度大于eda工具进步的现象。面对超大规模asic的设计，业界有两种倾向：一是提高设计的抽象层次，降低设计的复杂度，这主要由eda工具的发展来带动，较显著的是行为级综合工具的出现;二是提高设计的粒度，采用可复用的ip核，进行系统的集成。这都引发了eda工具和eda设计过程、设计结果新的标准化问题。
目前，eda工具众多，在给予设计者众多选择的同时，也会导致设计平台失去一致性，阻碍了设计结果的数据交换和共享，这也成为集成电路和eda工具发展的障碍。芯片复杂程度越高，对eda的依赖也越高，如果缺乏eda的底层技术及其接口的标准化，就不能很好地对涉及结果进行交换、共享及重用。
1 eda设计平台标准 广泛应用于eda的设计平台主要有两个：一是运行在各类unix系统下的桌面高端服务器型工程工作站;二是运行在各类微软windows操作系统下的桌面型pc机。复杂的芯片设计多采用unix工作站完成，而基于windows系统的pc机多用来完成pcb设计、fpga和可编程ic设计和一些底端的asic设计（用于设计过程中的所选择的一部分）。较流行的eda软件平台是unix工作站，其中受欢迎的计算环境主要包括：sunsoft的sun操作系统（正在过渡到solaris更新的版本），hewlett packard hp-ux，ibmaix，decosf/1等。由于windows平台的易用性，它越来越受到设计者的青睐。
iec/tc93的eda标准路线图专题研究组下的eii（eda互操作和集成）小组认为对cde（通用桌面工作环境）中的用户界面，windows和macintosh之间已经有足够的一致性，这个方面已不存在尚未解决的重要问题，计算环境和用户界面的标准推荐采用unix平台上的cde环境以及windows平台上的windows图形用户界面。
2 硬件描述语言及接口标准 2.1 硬件描述语言标准 硬件描述语言（hardware description language，hdl）用软件编程的方式来描述电子系统的逻辑功能、电路结构和连接形式。目前典型的硬件描述语言有vhdl，verilog，systemc等。美国硅谷较流行使用veriloghdl，而欧洲则较多使用vhdl。另外还有ahdl，用c/c++作为系统级设计语言则是一个新兴的方法，superlog，cynlibc++等新的硬件描述语言随着系统级fpga以及soc的发展、软硬件协调设计和系统设计的需求也发展了起来。
早期的硬件描述语言，如abel，hdl，ahdl，由不同的eda厂商开发，互不兼容，而且不支持多层次设计，层次间翻译工作要由人工完成，效率低下且容易出错。为了克服以上不足，1985年美国国防部正式推出了高速集成电路硬件描述语言vhdl，1987年ieee采纳vhdl为硬件描述语言标准（ieee1076-1987），第二个版本是在1993年制定的（vhdl-93）。vhdl同时也是军事标准（454）和ansi标准。作为一种硬件描述语言标准，vhdl为众多的eda厂商支持，且移植性好。
veriloghdl的使用也非常普遍，其对电路控制的灵活性方面它的效率比vhdl要高。在美国、日本等国verilog语言的使用率要远高于其他语言。veriloghdl在1995年成为ieee标准（ieee13641995），2001年发布了ieee1364-2001，目前正在进行新的修订（ieee1364-2005）。由于accellera标准组织决定将systemverilog3.1a（systemverilog是veriloghdl系统级扩展版）捐献给新的ieee工作组，而不是原先负责verilog标准化的ieee1364工作组，因此可能会导致两个verilog标准化工作，即ieee1364-2005和ieee1800，这也许会影响verilog语言的标准化，破坏该语言的统一性。 systemverilog于2004年获得了par（project authorization request，项目授权请求）编号，由ieee开展的标准化活动已经开始。据accellera会长丹尼斯·布罗菲（dennisb.brophy）介绍，systemverilog预计将在2005年内成为取消“p”字的ieee正式标准。
作为两大标准的硬件描述语言，vhdl和veriloghdl的互操作性非常重要，曾经vhdl和verilog的相应的国际组织vi（vhdl国际组织）、ovi（open verilog international，开放verilog国际组织，1999年成立）努力协调vhdl和verilog的互操作问题。2000年，vi和ovi这两个拥有丰富标准制定程序经验的组织合并成立了accellera。accellera正在进行assertion属性描述语言“psl”的标准化工作———ieee1850，pls预计也像systemverilog一样在2005年内成为ieee标准。
2.2 硬件描述语言与设计分析工具的接口标准 详细设计阶段包括面向给定工艺的详细逻辑设计（rtl描述）和物理设计（版图设计）。逻辑设计阶段创建和分析详细的逻辑，进行设计功能仿真、时序验证、可靠性分析以及给定逻辑的预布局及散热分析、功耗估计。物理设计是在版图设计规则和各种约束条件的指导下，设计的逻辑描述被物理综合为具体的版图数据，对整个版图的各种规则、寄生效应和时序进行分析（跨越设计层次、分层次互连模型、分层次寄生参数提取和建模的精确时序分析），对设计的质量和可靠性进行分析和度量（信号质量分析、能量网格分析、散热分析、功耗分析）。
在这方面，有许多国际标准和事实标准在使用，包括edif（electronicdesigninterchangeformat，电子设计交换格式，edif4.0.0现在已经成为eda标准，许多eda开发商如mentor，candence等都已采用。edif4.0.0实际上是eda建模的新方法，为一种语言描述形式），cfidr，pdef，def，spf，sdf等。edif，cfidr和pdes（stepap210）都不同程度地处理逻辑设计和物理设计的结果。但是，目前还没有适当的标准能够类似edif的处理途径以一致的方式用于逻辑连接，以支持基于文件的数据;也没有适当的标准能够以一致的方式用于类似dr处理途径的编程接口。对于芯片的物理设计数据也没有标准，虽然edifpcb/mcm被mcmasem联盟选作mcm物理设计数据的标准，但用于mcm物理设计数据的标准需要在edif中继续完善。cfi（cadframeworkinitiative，cad系统框架委员会，1988年在美国成立）组织正在通过edif汇聚成标准信息模型（最终通过pdes汇聚成通用的信息模型）。
2.3 逻辑连接标准 开发通用核心信息模型主要目的之一是处理逻辑互连，所有与逻辑互连有关的详细设计工业标准都应该是这个信息模型的一部分，这样，各种各样的工业信息模型就可以从这个标准而来。
当前业界使用的相关标准有edif，pcm/mcm，cfidr等。edif综合了多种格式中的最佳特性，1985年的edif1.0.0版本提供了门阵列、半导体集成电路设计和布线自动化交换信息的格式，而后的edif2.0.0版本是不同eda厂家之间交换设计数据的标准格式，edif4.0.0由eia（electronic industries association，电子工业协会）发布为标准，edif4.0.0成员大多是世界上著名的eda供应商及一些电子行业有影响力的协会等，主要由eia，ipc，曼彻斯特大学（universityof manchester），mentor graphics，solectron和hadco santa clara等机构与组织组成。cfi解决的是不同eda厂家工具集成和实时通信问题，edif格式解决的是用不同eda厂家工具完成设计的数据交流问题。
2.4 测试矢量标准 测试矢量标准既有许多正规的国际标准，又有许多事实上的标准，正规的标准包括waves（ieee1029.1），dtif（ieee1029.4）以及新的dasc协议。事实标准如summtdesign，teardyne，许多公司也建立了自己的内部格式标准。测试矢量规范的标准需要解决数字测试矢量如何从一种格式转换为另一种格式的问题。
3 eda系统框架结构 eda系统框架结构（framework）是一套配置和使用eda软件包的规范。目前主要的eda系统都建立了框架结构，如cadence公司的design framework，mentor公司的falcon framework，这些框架结构都遵守cfi组织制定的统一技术标准。框架结构能将来自不同eda厂商的工具软件进行优化组合，集成在统一环境之下，而且还支持任务之间、设计师之间以及整个产品开发过程中的信息传输与共享，是并行工程和自顶向下设计方法的实现基础。
系统框架为各种eda工具提供一个公用运行操作环境的软件系统，包括程序库、扩展语言版本管理、设计方法和设计流程管理、用户界面等。通过框架，用户可对各种eda工具实施管理，掌握设计执行过程，创建、组织和管理数据。eda系统框架的基本内容包括：数据模型及数据管理、设计方法管理、设计流程管理和用户界面4部分。1993年cfi正式颁布了cfi1.0框架规范和相应的规范遵从审核程序。cfi框架体系标准解决了实时的工具通信、工具嵌入方式和设计描述，使用户能够混合和匹配来自不同eda厂家的工具，构成集成的设计环境。
3.1 eda工具间的通信标准 集成电路设计规模的扩大、公司全球化的发展，要求eda工具提供支持基于网络的地理位置分散的开发环境，各应用工具可以通过信息进行交互，以组成横跨世界范围的网络。通过最大化工具间的通信和协同工作能力来缩短设计周期，而不是连续的文件翻译和整个设计部分的转移。这要求eda设计工具具有较高的独立性，以独立于其他的支持eda的技术如产品数据管理（pdm）技术，各种eda工具能够以特定的方式与pdm系统通信。
tooltalk通信工具（包含在cde中）已被cfi认可作为工具间通信机制标准。然而，仅有通用的通信工具还不够，各种应用工具必须使用消息通用集进行通信。cfi已经开发了一个关于eda消息字典的标准。cfi之所以推荐tooltalk，也与eda消息字典的扩展有关，tooltalk工具能够满足在unix环境类中所有已知的要求。但是，为满足运行在windows环境下与那些运行在unix环境下的工具间进行通信的需求、满足工作环境提供协同工作能力的需求，tooltalk工具还须进一步发展。关于与工具集成，cfi工具封装标准tes是现在这个领域仅有的一个标准，为满足eda行业的需要，tes也在不断发展和完善，目前已发展到可以支持将工具自动封装到cde环境。cif对传输接口（xti）采用x/open标准。
3.2 eda系统的扩展语言标准 扩展语言（extensionlanguage，el）是大多数eda系统和工具集的集成部分，用以给设计者和eda集成工具提供扩展其他工具的功能，流行的扩展语言包括skill，ample，基于设计的扩展语言如cfi扩展语言。另外，各种脚本语言也用于扩展eda系统，例如perl，tktcl。eda扩展语言的多样性导致使用扩展语言实现eda设计功能以及这些功能的维护、移植变得困难和昂贵。目前，由于eda扩展语言还没有统一，eda必须支持多种扩展语言的并存。从长远来看，最终需要一种标准的eda扩展语言，该标准扩展语言的可重复性、可移植性、工艺性良好，易于被设计者和eda集成工具使用。如今，cfi扩展语言在一定程度上已经作为一个标准扩展语言得到了广大eda工具和工具商的支持。perl也很流行，很多eda工具支持经过api访问perl扩展语言库。
扩展语言函数库能够为eda设计系统的对象和设计数据提供访问接口，能够给应用程序开发人员和eda集成工具及用户提供一致的图形用户界面和一系列的应用程序控件，与各种流行的扩展语言包括cfi扩展语言和perl兼容。
3.3 设计对象命名标准 当前很多设计工具可以使用命名惯例给eda设计对象命名。然而，在某些工具供应商的设计工具或系统中，这个名称有很多限制（例如名称的长度或者名称可用的字符集），而且名称对象的命名规则在不同的工具供应商之间、不同的应用系统之间不尽相同，在由不同工具供应商提供的多个应用系统构成的复杂设计环境下，设计对象命名依然存在一些混淆，尤其是当一些使用不同命名惯例的工具用于衔接紧密的设计循环的情况，于是产生了非常复杂的映射问题。为便于兼容与移植，需要新的设计对象命名标准，标准需要支持主要的设计对象命名惯例，并且支持与现有的设计工具的兼容，给出如何与现有命名惯例进行转化，能够通过工具间通信进行名字对象映射。
3.4 时序信息 0.35μm工艺下由于连线引起的延迟已经占到总延迟的80%～90%，系统设计经常需要在早期即把时序设计作为设计的一部分，时序约束已经成为一个关键约束。时序信息在分级和增量的基础上可作为过程接口的形式被加以利用，当前许多时序驱动的设计工具实际上都与标准延迟文件（sdf，是一个包含了大批量时序信息的文件）进行交互。处理sdf文件的工具将整个文件读入并通过分别给出的连接关系或设计的结构数据描述与时序数据进行关联。现存的标准（如edif，cfidr，ap210）还没有正式数据。标准延迟计算语言（dcl）要求时序信息被当前的标准如sdf支持，对于sdf的扩展应加以监控，以使得标准能够包含必要的信息。
4 ip核标准化 随着集成电路规模和复杂性的增大，基于ip复用技术的设计方法成为弥补设计生产效率和芯片密度之间的差距以及快速进入市场最有效的方法。调查显示，1995年掩模和设计的成本只占据整体的13%，而现在这个比例已升高到62%以上，ip在提高设计速度，降低成本中发挥着越来越重要的作用。“至2010年，ip的使用率将超过90%，基于ip的设计策略日益重要”。synopsys的ctoraulcamposano博士表示，“而同时存在的问题是如何解决ip多样性，这就需要建立标准的平台和开放式的数据库”。作为解决措施之一，业界正寻求通过建立ip标准化协会来克服这一棘手的问题。部分公司开始和代工厂合作提供更详细的ip信息，或与eda公司合作提供经过验证的ip，尽管如此，ip的标准化仍然是个很大的问题。在ip核的使用过程中，来自不同厂商的ip集成于同一个芯片中时，会带来很多整合的问题，集成的效果难以达到理想状态。
ip可用性、可复用性、质量评估、建库及ip交易需要统一的标准来支持。国际上关于ip设计、可用性、可复用性及质量评估及其标准化等从20世纪90年代后期开始，交易市场也初步形成。目前，在世界半导体产业的主要国家和地区，都相继建立了ip/soc设计、交易、管理的组织和机构，包括vsia（美国），vcx（英国），d&r（法国），iptc（日本），sipca（韩国），rapid，***soc推动联盟等。这些组织积极进行ip标准化工作，促进了ip产业的发展。ip/soc的标准主要由vsia（virtual socket interface alliance，虚拟插座接口联盟）制定，目前vsia已经发布的ip核复用的各种文件中，包括8个规范、5个标准、4个分类法文件、一个质量度量电子表格软件以及其他几个文件，主要是ip核的复用设计标准、交付使用标准。
虽然ip核标准化取得了一定进展，但ip核的设计及使用仍不尽人意，从标准化的角度来讲，迫切需要解决ip核标准的适应性和可接受性问题。首先，因为ip核标准独立于具体器件、具体公司、具体工具、具体工艺，所以一方面标准的一些属性过于细致，使设计者很难确定合适的值，但另一方面又有一些属性不完备，不能很好地说明器件的特性。其次，目前多数ip核标准仍在试行阶段，标准的推广和用户的认可程度不尽人意。各个设计公司，尤其是大型的成熟公司都有自己的内部标准，行业组织推出的标准很难在这些公司内部推广。再次，目前在设计领域充斥着各种概念和术语，设计人员之间、以及公司之间使用的术语往往不一致，但这些术语的统计、确认以及让设计人员接受和认可这些标准仍需要时间。最后，目前专门用于ip设计的工具仍是空白，大多数设计工具对ip核的设计、ip库的管理和使用无能为力，ip的设计、管理和使用方面的标准化有待发展。
随着超大规模集成电路和系统芯片设计的发展，eda工具制造商正在尽力提高逻辑抽象的层次，eda也向更高级的描述语言和全集成的验证环境、以及如何将模拟功能集成到数字电路中、分层次设计方法和增量处理等方向发展。eda设计、测试、封装等多个环节密不可分，eda标准化范畴很大，本文只粗浅地介绍了其中的部分内容。
eda标准化已经取得了很大进展，但相关标准和亟待发展的标准依然很多，迫切需要eda行业广泛参与并达成一致，代工厂、工具供应商和芯片设计师加强彼此联系与协作。eda产业的发展也产生了新的标准化问题，如代工工艺设计流程套件（pdks）的标准化等。
dfm（可制造性设计）已经出现动向。eda标准化团体美国si2（silicon integrated initiative）和半导体制造设备业界团体semi（semiconductor equipmentand materials institute，导体设备暨材料协会）已经展开合作，开始建立“designto manu facturing coalition（设计与制造的统一）”的dfm应用标准化平台，semi的数据模型“universal data model（udm，通用数据模型）”和open access正逐渐成为事实标准。si2制定的“lef（library exchange format），def（design exchange format）”也在成为更加完善的工业技术标准。此外，si2也正致力于ip有关的标准化工作。
无论是eda的使用还是eda工具本身，我国与先进国家相比都有很大差距。eda标准化工作在我国刚刚起步，我国有庞大的市场需求和高的增长速度，同时还有后发优势，这是我国eda发展的楔机。在eda标准化方面，目前主要应采用国际和国外先进标准，一方面引进和转化适用的标准，更重要的是加强转化后标准的宣传和推广，通过标准化工作促进我国eda及集成电路产业的发展。
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