LogiCORE IP AXI4-Stream FIFO内核解决方案
pg080中文文档简介
logicore ip axi4-stream fifo内核允许以内存映射方式访问一个axi4-stream接口。该内核可用于与axi4-stream ip接口，类似于logicore ip axi以太网内核，而无需使用完整的dma解决方案。
该内核的主要操作是向设备写入或从设备读取数据包，而无需考虑axi4-stream接口的信令。由于axi4-stream接口是透明的，因此可以轻松进行管理。
协议说明
axi4-stream fifo内核使用行业标准amba axi4-stream和axi4协议规范。图3-2详细介绍了axi4-stream接口，其中information表示除tvalid/tready以外的所有axi4-stream信号。
本节以 axi 以太网内核为例，通过寄存器访问介绍 axi4-stream fifo 内核的运行。
根据数据接口选项的不同，先进先出设备访问可使用 axi4 或 axi4-lite。选择 axi4-lite 时，寄存器访问和 fifo 访问由 axi4-lite 接口处理。选择 axi4 时，寄存器访问由 axi4-lite 接口处理，fifo 访问由 axi4 接口处理。当数据接口选项为 axi4 时，数据突发是可能的。
axi4-stream fifo 支持两种数据包传输模式：存储转发模式和直通模式。
• 在存储转发模式下，数据包传输在以下情况下从 axi4-stream 接口开始： ° 当完整数据包写入 fifo 时
° 数据包长度写入 tx 长度寄存器。
在这种模式下， fifo 的大小必须足以容纳完整的数据包。
• 在直通模式下，当 fifo 中有足够的数据时， axi4-stream 接口上就开始传输数据包。在这种模式下，先进先出存储器无需保存完整的数据包。不过，要确保 axi4-stream 接口不会运行不足。
部分翻译截图(上下滑动查看)
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在这种模式下， fifo 的大小必须足以容纳完整的数据包。
• 在直通模式下，当 fifo 中有足够的数据时， axi4-stream 接口上就开始传输数据包。在这种模式下，先进先出存储器无需保存完整的数据包。不过，要确保 axi4-stream 接口不会运行不足。
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