优秀的高速PCB设计之去耦电容
电源和地平面
应该尽可能的使用电源和地平面，
why?
在设备和电源之间提供一个低阻抗的
路径
提供屏蔽
提供散热
降低分布电感
一个完整的无破损的平面是最优选择
破碎的地平面会在走线的上下层之间引入寄生电感
remember!
低频时，电流总是流过最小电阻路径
高频时，电流总是渡过最小电感路径
去耦电容（或“旁路电容”）
当设备里的门电路开关时，设备里的阻抗会有一个瞬时的变化
结果就是电流会有一个瞬时的变化
去耦电容会这些瞬时的变化提供一个低阻抗的电流源
降低电源地之间的电压波动
帮助电源地信号工作在设备的工作spec之内
高速设计中有5个频段需要调节
dc至10khz
通过调节模块来调节
10khz至100khz
通过去耦电容来调节
100khz to 10mhz
通过100nf(0.1uf）来调节
10 mhz to 100mhz
通过10 nf来调节
100mhz至更高
通过1nf和pcb电源和地平面来调节
需要多少去耦电容才够用呢？
取决于系统
需要考虑工作频率，i/o的开关数量，每个pin脚的容性负载，走线的特征阻抗， 结点的温度，芯片内部的运算
对于处理器，要考虑各种运算方式，缓存，内存，dma，等等
经验法则：从dc至高频的每个频段内，供电引脚的电压波动都就小于5%
dc供电电压的最大波动加上噪声的最大值应该小于供电电压的5%
需要一个足够带宽的示波器
有很多的方法去评估总共需要的容值，以及如何分布电容
这是一个复杂的问题，特别是在处理现在那些包含有成千上万门电电路的处理器的时候.
为了获得最好的性能， 应该尽可能的降低供 电引脚与去耦电容之 间的电感与电阻
pcb布线和过孔会增加阻抗
当使用电源/地平面对时，电容如同在pcb顶层 一样有效
100mhz以上的有效电容…
随着时钟频率和边缘变化率的提高，如何有效的使用旁路电容变得越来越困难
电容的esl（等效串联电感）随着频率的增加而增加
电容的esr（等效串联电阻）的增加会降低电容的效力
电容的寄生参数（pads,vias）所带来的电抗会随着频率增加而增加
100nf的电容在100mhz之上是无用的
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100mhz以上的有效电容…
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电容的esr（等效串联电阻）的增加会降低电容的效力
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