FPGA从Xilinx的7系列学起（6）
2.3 7 系列blockram使用三种模式
2.3.1 简单单口blockram
如上图所示，简单的单口ram的端口非常简单：
时钟: clka，
地址: addra
写使能: wea，
写数据: dia，
读数据: doa，
还有一些其他的非必须的端口图中就没有一一列出来了。
以前我们讲过，blockram都是真正的双口ram，但是有时候需要简单有效的配置方式，用户就会选择使用简单的单口ram的模式。类似于中国人说的弱水三千只取一瓢，你纵使有各种的灵活性，我还是选择最适合我的配置方式。由于blockram可以分割成36k或18k位的大小，下面列出来当用户你完全使用36kb ram的时候能够配置的方式和用户只使用18kb ram的时候能够配置的模式。对于36kb大小的空间可以配制成：32k x 1, 16k x 2, 8k x 4, 4k x 9, 2k x 18, 1k x 36；对于18kb的空间可以配置成： 16k x 1, 8k x 2, 4k x 4,2k x 9, 1k x 18, 512 x 36。另外也允许用户配置的写模式有三种：
write_first: 同时读写相同地址时，从dia写入的数据立即在doa上可见，也就是写优先；
read_first: 同时读写相同地址时，以前的数据还是出现在doa上，也就是读优先；
no_change: doa一直保持以前的数据(可以节省功耗)。
这些配置都是你在例化blockram的gui界面上可以选择的。
另外说一下，除了上面显示的信号，简单的端口ram端口还有其他端口：
读使能：ena，
输出锁存器复位：rstrama，
输出寄存器复位：rstrega
输出寄存器芯片使能：regcea，
为简化起见，dia和doa总线被示出为包括校验位，校验位和数据实际是不同的总线，他们分别是dipa和dopa。rst，ce，和clk信号高低有效的使能是可编程的决定。其他rst信号是同步的reset信号。regcea优先级是否超过rstrega是通过rstreg_priority属性来编程。另外，即使是写使能不是有效的时候，也要确保address线上没有时序错误。
2.3.2 真正的双口block ram
端口信息如图所示，就不一一赘述了。真正的双端口的ram有两个独立的读/写端口，每个端口都有独立的时钟、地址、输入数据、输出数据、写使能等等。两个端口的时钟可以设置成同步或者异步；和简单的端口ram不同的是真正的双端口ram可以配置成不同的宽度。同时两个端口可以具有不同的写模式。那么就要求用户在写之前执行读，或者读之前执行写。这在例化blockram的gui界面中设置。这是非常重要，用户可以进行对一个位置进行读写，但是这个操作可能导致用户需求数据发生冲突产生错误，所以必须确保您的地址和控制信号不会造成数据冲突。只有在一种情况下不会发生错误，就是读写的时钟相同，写端口的写模式是read_first，读端口是要求使用旧数据。
2.3.3 简单的双口block ram
端口信息同样如图所示，也就不一一赘述了。blockram有时候会被配置成为简单的双端口ram。在这种配置模式下，每个端口分配为读或写功能，根据用户使用的blockram大小，可以被配制成不同的模式：对于36kb大小的空间的，两个端口中的一个被配置成72位；对于18kb的空间的，两个端口中的一个被配置成32位。这是因为如果宽端口是没有必要的，用户只需要使用一个真实的双端口ram来代替，甚至一个简单的双端口ram的功能就足够了。
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读数据: doa，
还有一些其他的非必须的端口图中就没有一一列出来了。
以前我们讲过，blockram都是真正的双口ram，但是有时候需要简单有效的配置方式，用户就会选择使用简单的单口ram的模式。类似于中国人说的弱水三千只取一瓢，你纵使有各种的灵活性，我还是选择最适合我的配置方式。由于blockram可以分割成36k或18k位的大小，下面列出来当用户你完全使用36kb ram的时候能够配置的方式和用户只使用18kb ram的时候能够配置的模式。对于36kb大小的空间可以配制成：32k x 1, 16k x 2, 8k x 4, 4k x 9, 2k x 18, 1k x 36；对于18kb的空间可以配置成： 16k x 1, 8k x 2, 4k x 4,2k x 9, 1k x 18, 512 x 36。另外也允许用户配置的写模式有三种：
write_first: 同时读写相同地址时，从dia写入的数据立即在doa上可见，也就是写优先；
read_first: 同时读写相同地址时，以前的数据还是出现在doa上，也就是读优先；
no_change: doa一直保持以前的数据(可以节省功耗)。
这些配置都是你在例化blockram的gui界面上可以选择的。
另外说一下，除了上面显示的信号，简单的端口ram端口还有其他端口：
读使能：ena，
输出锁存器复位：rstrama，
输出寄存器复位：rstrega
输出寄存器芯片使能：regcea，
为简化起见，dia和doa总线被示出为包括校验位，校验位和数据实际是不同的总线，他们分别是dipa和dopa。rst，ce，和clk信号高低有效的使能是可编程的决定。其他rst信号是同步的reset信号。regcea优先级是否超过rstrega是通过rstreg_priority属性来编程。另外，即使是写使能不是有效的时候，也要确保address线上没有时序错误。
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端口信息如图所示，就不一一赘述了。真正的双端口的ram有两个独立的读/写端口，每个端口都有独立的时钟、地址、输入数据、输出数据、写使能等等。两个端口的时钟可以设置成同步或者异步；和简单的端口ram不同的是真正的双端口ram可以配置成不同的宽度。同时两个端口可以具有不同的写模式。那么就要求用户在写之前执行读，或者读之前执行写。这在例化blockram的gui界面中设置。这是非常重要，用户可以进行对一个位置进行读写，但是这个操作可能导致用户需求数据发生冲突产生错误，所以必须确保您的地址和控制信号不会造成数据冲突。只有在一种情况下不会发生错误，就是读写的时钟相同，写端口的写模式是read_first，读端口是要求使用旧数据。
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端口信息同样如图所示，也就不一一赘述了。blockram有时候会被配置成为简单的双端口ram。在这种配置模式下，每个端口分配为读或写功能，根据用户使用的blockram大小，可以被配制成不同的模式：对于36kb大小的空间的，两个端口中的一个被配置成72位；对于18kb的空间的，两个端口中的一个被配置成32位。这是因为如果宽端口是没有必要的，用户只需要使用一个真实的双端口ram来代替，甚至一个简单的双端口ram的功能就足够了。
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