利用锁相时钟抑制串模干扰
目前广泛使用的3 1/2~5 1/2位数字电压表（dvm），大多选用双积分式或多重积分式单片a/d转换器。其优点是电路简单，抗串模干扰能力强，成本较低。只要设计的时钟频率f0恰好等于50hz的整倍数，电网串模干扰就被完全抑制掉了。然而电网频率实际上并不稳定，
钟频率，还可配max133/max134、hi7159型4 3/4~5 1/2位单片a/d转换器使智能数字电压表的电磁兼容性得到改善。
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