系统级ESD电路保护设计考虑因素
引言
随着技术的发展，移动电子设备已成为我们生活和文化的重要组成部分。平板电脑和智能手机触摸技术的应用，让我们能够与这些设备进行更多的互动。它构成了一个完整的静电放电 （esd） 危险环境，即人体皮肤对设备产生的静电放电。例如，在使用消费类电子设备时，在用户手指和平板电脑 usb 或者 hdmi 接口之间会发生 esd，从而对平板电脑产生不可逆的损坏，例如：峰值待机电流或者永久性系统失效。
本文将为您解释系统级 esd 现象和器件级 esd 现象之间的差异，并向您介绍一些提供 esd 事件保护的系统级设计方法。
系统级esd保护与器件级esd保护的对比
ic 的 esd 损坏可发生在任何时候，从装配到板级焊接，再到终端用户人机互动。esd 相关损坏最早可追溯到半导体发展之初，但在 20 世纪 70 年代微芯片和薄栅氧化 fet 应用于高集成 ic 以后，它才成为一个普遍的问题。所有 ic 都有一些嵌入式器件级 esd 结构，用于在制造阶段保护 ic 免受 esd 事件的损坏。这些事件可由三个不同的器件级模型进行模拟：人体模型 （hbm）、机器模型 （mm） 和带电器件模型 （cdm）。hbm 用于模拟用户操作引起的 esd 事件，mm 用于模拟自动操作引起的 esd 事件，而 cdm 则模拟产品充电/放电所引起的 esd 事件。这些模型都用于制造环境下的测试。在这种环境下，装配、最终测试和板级焊接工作均在受控 esd 环境下完成，从而减小暴露器件所承受的 esd 应力。在制造环境下，ic 一般仅能承受 2-kv hbm 的 esd 电击，而最近出台的小型器件静电规定更是低至 500v。
尽管在厂房受控 esd 环境下器件级模型通常已足够，但在系统级测试中它们却差得很远。在终端用户环境下，电压和电流的esd电击强度要高得多。因此，工业环境使用另一种方法进行系统级 esd 测试，其由 iec 61000-4-2 标准定义。器件级 hbm、mm和cdm 测试的目的都是保证 ic 在制造过程中不受损坏；iec 61000-4-2规定的系统级测试用于模拟现实世界中的终端用户esd事件。
iec 规定了两种系统级测试：接触放电和非接触放电。使用接触放电方法时，测试模拟器电极与受测器件 （dut） 保持接触。非接触放电时，模拟器的带电电极靠近 dut，同 dut 之间产生的火花促使放电。
表 1 列出了 iec 61000-4-2 标准规定的每种方法的测试级别范围。请注意，两种方法的每种测试级别的放电强度并不相同。我们通常在4级（每种方法的最高官方标称级别）以上对应力水平进行逐级测试，直到发生故障点为止。
表 1 接触放电和非接触放电方法的测试电平
器件级模型和系统级模型有一些明显的区别，表 2 列出了这些区别。表 2 中最后三个参数（电流、上升时间和电击次数）需特别注意：
l 电流差对于 esd 敏感型器件是否能够承受一次 esd 事件至关重要。由于强电流可引起结点损坏和栅氧化损坏，8-kv hbm 保护芯片（峰值电流5.33a）可能会因 2-kv iec 模型电击（峰值电流 7.5a）而损坏。因此，系统设计人员不能把 hbm 额定值同 iec 模型额定值混淆，这一点极为重要。
l 另一个差异存在于电压尖峰上升时间。hbm 的规定上升时间为 25ns。iec 模型脉冲上升时间小于 1ns，其在最初 3ns 消耗掉大部分能量。如果 hbm 额定的器件需 25ns 来做出响应，则在其保护电路激活以前器件就已被损坏。
l 两种模型在测试期间所用的电击次数不同。hbm仅要求测试一次正电击和一次负电击，而 iec 模型却要求 10 次正电击和 10 次负电击。可能出现的情况是，器件能够承受第一次电击，但由于初次电击带来的损坏仍然存在，其会在后续电击中失效。图 1 显示了 cdm、hbm 和 iec 模型的 esd 波形举例。很明显，相比所有器件级模型的脉冲，iec 模型的脉冲携带了更多的能量。
表 2 器件级模型与 iec 系统级模型比较
图 1 器件级和 iec 模型的 esd 波形
tvs 如何保护系统免受 esd 事件的损害
与 esd 保护集成结构不同，iec 61000-4-2 标准规定的模型通常会使用离散式独立瞬态电压抑制二极管，也即瞬态电压抑制器 （tvs）。相比电源管理或者微控制器单元中集成的 esd 保护结构，独立 tvs 成本更低，并且可以靠近系统 i/o 连接器放置，如图 2 所示。
图 2 系统级 tvs 布局
共有两种 tvs：双向和单向（参见图 3）。ti tpd1e10b06 便是一个双向 tvs例子，它可以放置在一条通用数据线路上，用于系统级 esd 保护。正常工作状态下，双向和单向 tvs 都为一个开路，并在 esd 事件发生时接地。在双向 tvs 情况下，只要 d1 和 d2 都不进入其击穿区域，i/o 线路电压信号会在接地电压上下摆动。当 esd 电击（正或者负）击中 i/o 线路时，一个二极管变为正向偏置，而另一个击穿，从而形成一条通路，esd 能量立即沿这条通路接地。在单向 tvs 情况下，只要 d2 和 z1 都不进入其击穿区域，则电压信号会在接地电压以上摆动。当正esd电击击中i/o线路时，d1变为正向偏置，而z1 先于 d2 进入其击穿区域；通过 d1 和 z1 形成一条接地通路，从而让 esd 能量得到耗散。当发生负 esd 事件时，d2 变为正向偏置，esd能量通过 d2接地通路得到耗散。由于 d1 和 d2 尺寸可以更小、寄生电容更少，单向二极管可用于许多高速应用；d1 和 d2 可以“隐藏”更大的齐纳二极管 z1（大尺寸的原因是处理击穿区域更多的电流）。
图 3 双向和单向 tvs
系统级 esd 保护的关键器件参数
图 4 显示了 tvs 二极管电流与电压特性的对比情况。尽管 tvs 是一种简单的结构，但是在系统级 esd 保护设计过程中仍然需要注意几个重要的参数。这些参数包括击穿电压 vbr、动态电阻 rdyn、钳位电压 vcl 和电容。
图 4 tvs 二极管电流与电压的关系
击穿电压
正确选择 tvs 的第一步是研究击穿电压 （vbr）。例如，如果受保护 i/o 线路的最大工作电压 vrwm 为 5v，则在达到该最大电压以前 tvs 不应进入其击穿区域。通常，tvs 产品说明书会包括具体漏电流的 vrwm，它让我们能够更加容易地选择正确的 tvs。否则，我们可以选择一个 vbr（min） 大于受保护 i/o 线路 vrwm 几伏的 tvs。
动态电阻
esd 是一种极速事件，也就是几纳秒的事情。在如此短的时间内，tvs 传导接地通路不会立即建立起来，并且在通路中存在一定的电阻。这种电阻被称作动态电阻 （rdyn），如图 5 所示。
图 5 esd 电流放电通路
理想情况下，rdyn 应为零，这样 i/o 线路电压才能尽可能地接近 vbr；但是，这是不可能的事情。rdyn 的最新工业标准值为 1 ? 或者 1 ? 以下。利用传输线路脉冲测量技术可以得到 rdyn。使用这种技术时，通过 tvs 释放电压，然后测量相应的电流。在得到不同电压的许多数据点以后，便可以绘制出如图6一样的 iv 曲线，而斜线便为 rdyn。图 6 显示了 tpd1e10b06 的 rdyn，其典型值为 ~0.3 ?。
图 6 tpd1e10b06 的 iv 特性
钳位电压
由于esd是一种极速瞬态事件，i/o 线路的电压不能立即得到箝制。如图 7 所示，根据 iec 61000-4-2 标准，数千伏电压被箝制为数十伏。如方程式 1 所示，rdyn 越小，钳位性能也就越好：
其中，ipp 为 esd 事件期间的峰值脉冲电流，而 iparasitic 为通过 tvs 接地来自连接器的线路寄生电感。
图 7 8kv 接触放电的 esd 事件钳位
把钳位电压波形下面的区域想像成能量。钳位性能越好，受保护esd敏感型器件在esd事件中受到损坏的机率也就越小。由于钳位电压很小，一些tvs可承受iec模型的8kv接触式放电，但是“受保护”器件却被损坏了。
电容
在正常工作状态下，tvs为一个开路，并具有寄生电容分流接地。设计人员应在信号链带宽预算中考虑到这种电容。
结论
由于 ic 工艺技术节点变得越来越小，它也越来越容易受到 esd 损坏的影响，不管是在制造过程还是在终端用户使用环境下。器件级 esd 保护并不足以在系统层面为 ic 提供保护。我们应在系统级设计中使用独立 tvs。在选择某个 tvs 时，设计人员应注意一些重要参数，例如：vbr、rdyn、vcl 和电容等。
参考文献
《系统级esd/emi保护设计指南》 www.ti.com/lit/sszb130b
相关网站
esd解决方案：http://www.ti.com.cn/product/cn/tpd1e10b06
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本文将为您解释系统级 esd 现象和器件级 esd 现象之间的差异，并向您介绍一些提供 esd 事件保护的系统级设计方法。
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ic 的 esd 损坏可发生在任何时候，从装配到板级焊接，再到终端用户人机互动。esd 相关损坏最早可追溯到半导体发展之初，但在 20 世纪 70 年代微芯片和薄栅氧化 fet 应用于高集成 ic 以后，它才成为一个普遍的问题。所有 ic 都有一些嵌入式器件级 esd 结构，用于在制造阶段保护 ic 免受 esd 事件的损坏。这些事件可由三个不同的器件级模型进行模拟：人体模型 （hbm）、机器模型 （mm） 和带电器件模型 （cdm）。hbm 用于模拟用户操作引起的 esd 事件，mm 用于模拟自动操作引起的 esd 事件，而 cdm 则模拟产品充电/放电所引起的 esd 事件。这些模型都用于制造环境下的测试。在这种环境下，装配、最终测试和板级焊接工作均在受控 esd 环境下完成，从而减小暴露器件所承受的 esd 应力。在制造环境下，ic 一般仅能承受 2-kv hbm 的 esd 电击，而最近出台的小型器件静电规定更是低至 500v。
尽管在厂房受控 esd 环境下器件级模型通常已足够，但在系统级测试中它们却差得很远。在终端用户环境下，电压和电流的esd电击强度要高得多。因此，工业环境使用另一种方法进行系统级 esd 测试，其由 iec 61000-4-2 标准定义。器件级 hbm、mm和cdm 测试的目的都是保证 ic 在制造过程中不受损坏；iec 61000-4-2规定的系统级测试用于模拟现实世界中的终端用户esd事件。
iec 规定了两种系统级测试：接触放电和非接触放电。使用接触放电方法时，测试模拟器电极与受测器件 （dut） 保持接触。非接触放电时，模拟器的带电电极靠近 dut，同 dut 之间产生的火花促使放电。
表 1 列出了 iec 61000-4-2 标准规定的每种方法的测试级别范围。请注意，两种方法的每种测试级别的放电强度并不相同。我们通常在4级（每种方法的最高官方标称级别）以上对应力水平进行逐级测试，直到发生故障点为止。
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器件级模型和系统级模型有一些明显的区别，表 2 列出了这些区别。表 2 中最后三个参数（电流、上升时间和电击次数）需特别注意：
l 电流差对于 esd 敏感型器件是否能够承受一次 esd 事件至关重要。由于强电流可引起结点损坏和栅氧化损坏，8-kv hbm 保护芯片（峰值电流5.33a）可能会因 2-kv iec 模型电击（峰值电流 7.5a）而损坏。因此，系统设计人员不能把 hbm 额定值同 iec 模型额定值混淆，这一点极为重要。
l 另一个差异存在于电压尖峰上升时间。hbm 的规定上升时间为 25ns。iec 模型脉冲上升时间小于 1ns，其在最初 3ns 消耗掉大部分能量。如果 hbm 额定的器件需 25ns 来做出响应，则在其保护电路激活以前器件就已被损坏。
l 两种模型在测试期间所用的电击次数不同。hbm仅要求测试一次正电击和一次负电击，而 iec 模型却要求 10 次正电击和 10 次负电击。可能出现的情况是，器件能够承受第一次电击，但由于初次电击带来的损坏仍然存在，其会在后续电击中失效。图 1 显示了 cdm、hbm 和 iec 模型的 esd 波形举例。很明显，相比所有器件级模型的脉冲，iec 模型的脉冲携带了更多的能量。
表 2 器件级模型与 iec 系统级模型比较
图 1 器件级和 iec 模型的 esd 波形
tvs 如何保护系统免受 esd 事件的损害
与 esd 保护集成结构不同，iec 61000-4-2 标准规定的模型通常会使用离散式独立瞬态电压抑制二极管，也即瞬态电压抑制器 （tvs）。相比电源管理或者微控制器单元中集成的 esd 保护结构，独立 tvs 成本更低，并且可以靠近系统 i/o 连接器放置，如图 2 所示。
图 2 系统级 tvs 布局
共有两种 tvs：双向和单向（参见图 3）。ti tpd1e10b06 便是一个双向 tvs例子，它可以放置在一条通用数据线路上，用于系统级 esd 保护。正常工作状态下，双向和单向 tvs 都为一个开路，并在 esd 事件发生时接地。在双向 tvs 情况下，只要 d1 和 d2 都不进入其击穿区域，i/o 线路电压信号会在接地电压上下摆动。当 esd 电击（正或者负）击中 i/o 线路时，一个二极管变为正向偏置，而另一个击穿，从而形成一条通路，esd 能量立即沿这条通路接地。在单向 tvs 情况下，只要 d2 和 z1 都不进入其击穿区域，则电压信号会在接地电压以上摆动。当正esd电击击中i/o线路时，d1变为正向偏置，而z1 先于 d2 进入其击穿区域；通过 d1 和 z1 形成一条接地通路，从而让 esd 能量得到耗散。当发生负 esd 事件时，d2 变为正向偏置，esd能量通过 d2接地通路得到耗散。由于 d1 和 d2 尺寸可以更小、寄生电容更少，单向二极管可用于许多高速应用；d1 和 d2 可以“隐藏”更大的齐纳二极管 z1（大尺寸的原因是处理击穿区域更多的电流）。
图 3 双向和单向 tvs
系统级 esd 保护的关键器件参数
图 4 显示了 tvs 二极管电流与电压特性的对比情况。尽管 tvs 是一种简单的结构，但是在系统级 esd 保护设计过程中仍然需要注意几个重要的参数。这些参数包括击穿电压 vbr、动态电阻 rdyn、钳位电压 vcl 和电容。
图 4 tvs 二极管电流与电压的关系
击穿电压
正确选择 tvs 的第一步是研究击穿电压 （vbr）。例如，如果受保护 i/o 线路的最大工作电压 vrwm 为 5v，则在达到该最大电压以前 tvs 不应进入其击穿区域。通常，tvs 产品说明书会包括具体漏电流的 vrwm，它让我们能够更加容易地选择正确的 tvs。否则，我们可以选择一个 vbr（min） 大于受保护 i/o 线路 vrwm 几伏的 tvs。
动态电阻
esd 是一种极速事件，也就是几纳秒的事情。在如此短的时间内，tvs 传导接地通路不会立即建立起来，并且在通路中存在一定的电阻。这种电阻被称作动态电阻 （rdyn），如图 5 所示。
图 5 esd 电流放电通路
理想情况下，rdyn 应为零，这样 i/o 线路电压才能尽可能地接近 vbr；但是，这是不可能的事情。rdyn 的最新工业标准值为 1 ? 或者 1 ? 以下。利用传输线路脉冲测量技术可以得到 rdyn。使用这种技术时，通过 tvs 释放电压，然后测量相应的电流。在得到不同电压的许多数据点以后，便可以绘制出如图6一样的 iv 曲线，而斜线便为 rdyn。图 6 显示了 tpd1e10b06 的 rdyn，其典型值为 ~0.3 ?。
图 6 tpd1e10b06 的 iv 特性
钳位电压
由于esd是一种极速瞬态事件，i/o 线路的电压不能立即得到箝制。如图 7 所示，根据 iec 61000-4-2 标准，数千伏电压被箝制为数十伏。如方程式 1 所示，rdyn 越小，钳位性能也就越好：
其中，ipp 为 esd 事件期间的峰值脉冲电流，而 iparasitic 为通过 tvs 接地来自连接器的线路寄生电感。
图 7 8kv 接触放电的 esd 事件钳位
把钳位电压波形下面的区域想像成能量。钳位性能越好，受保护esd敏感型器件在esd事件中受到损坏的机率也就越小。由于钳位电压很小，一些tvs可承受iec模型的8kv接触式放电，但是“受保护”器件却被损坏了。
电容
在正常工作状态下，tvs为一个开路，并具有寄生电容分流接地。设计人员应在信号链带宽预算中考虑到这种电容。
结论
由于 ic 工艺技术节点变得越来越小，它也越来越容易受到 esd 损坏的影响，不管是在制造过程还是在终端用户使用环境下。器件级 esd 保护并不足以在系统层面为 ic 提供保护。我们应在系统级设计中使用独立 tvs。在选择某个 tvs 时，设计人员应注意一些重要参数，例如：vbr、rdyn、vcl 和电容等。
参考文献
《系统级esd/emi保护设计指南》 www.ti.com/lit/sszb130b
相关网站
esd解决方案：http://www.ti.com.cn/product/cn/tpd1e10b06
全自动袋料机器人码垛机要如何维护保养 帕斯科山东机器人科技有限公司
TE推出滑轨电源连接器 简单的设计降低了电源断开的风险
如何为无人驾驶保驾护航
LED恒流驱动器件MOSFET选择
筋膜枪三合一驱动控制板方案分享
系统级ESD电路保护设计考虑因素
峰谷电价差调整，储能投资收益估算
全固态电池能够引领动力电池的未来？
如何使用Arduino控制无刷电机
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