CY7C68013A FX2LP与FPGA连接的方法
cy7c68013a概述
usb接口有着速度快，成本低的优点，在现代计算机上已经成为了必备接口。usb2.0 high-speed接口理论速度为480mbit/s，实际使用带宽在200m以上，在一些对可靠性以及实时性要求不是特别高的场合，usb简单易用开发容易的特点使得其成为最佳的通讯接口选择。赛普拉斯 ez-usb®fx2lp™ (cy7c68013a/14a)是高度集成、低功耗 usb 2.0 的微控制器。其接口速率可以达到96mbytes/s，且成本仅仅十多元rmb。
cy7c68013a(fx2lp)同fpga连接
我们在一些定制设备中使用了usb接口，现在市场上最主流的usb外设接口芯片为cypress公司的cy7c68013a，为了实现高带宽的通讯，cy7c68013需要工作在gpif或者slave fifo模式，初学者往往对这两种模式不是很清楚，结合我们已有的经验，我们对两种模式做一下简要的说明：
gpif模式适合cy7c68013主动同外部芯片通讯，gpif通过几个控制信号来实现状态机的转换，进而产生不同的时序。在外接sram、cmos sensor、cpu、dsp等场合可以使用这个模式,其中dsp、cpu工作在从模式；
slave fifo模式适合同fpga等自身可以跑状态机的芯片配合使用。
在利用cy7c68013同fpga通讯的时候，一般使用slave fifo模式。ez-usb_trm2中第9章即是详细讲述slave fifo模式的。在cy7c68013中一共有4个端点，每一个端点都可以收或者发，对应的slave fifo有2条地址线用来选择相应的端点缓冲区。slave fifo一个很重要的设置就是时钟设置，其可以工作异步或者同步模式，在实际使用时，推荐同步模式，为了降低成本，可以使用cy7c68013自身产生的48mhz时钟，详细的设置说明可以看fig.9-6。slave fifo有4个标志引脚用来指示fifo状态（空、半满、满、自定义等），在fpga中写状态机的时候需要用到这几个引脚，特别注意的是flagd引脚可以用作slave fifo的片选，当总线上有不止一个设备的时候需要用到这个功能，其他时候可以不考虑。其他的引脚和标准的fifo没有什么特别，大家一看就可以明白。利用51程序将cy7c68013初始化好后，计算机同fpga的通讯即可以打通。如果使用了多个端点，在fpga上就要注意有一个有效的调度算法，以免某一个端点缓冲区内的数据迟迟不取出来导致通讯出错。
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