两分钟速度了解 Altera最新28nm FPGA技术演示图片及资料
altera 在北京展示了号称业界最全面的28nm 最新技术及强大解决方案。altera公司的多位工程师为在京的媒体人士进行了讲解。下面是演示图片、相关资料及简短说明。
altera工程师为媒体朋友现场讲解
首先是面向带宽设计的stratix v gt fpga系列。该器件基于tsmc 28nm hp高性能工艺制程，单管芯集成收发器和fpga确保高性能互连。集成4路28.05gb/s极高速双工收发器，单通道功耗仅200mw。它同时集成32路0.6-12.5gb/s通用高速双工收发器。
业界唯一集成28gb/s收发器的量产fpga
收发器是altera引以自豪的技术。stratix v的收发器芯片到芯片速度达到28gb/s，芯片到背板速度为14gb/s（受限于连接器的信号衰减）。图片右侧是专门从泰克公司借来的设备，据说两台仪器价值分别为100万美元和50万美元。经过10英尺的线路板，数字分析仪显示出stratix v漂亮的眼图。
下面的演示用的是stratix v gx开发板。stratix v gx器件可提供多达66个全双工600mb/s到14.1gb/s的高速收发器通道，具备符合10gbase-kr和cei-11g标准的高速背板支持能力。它支持edc以简化与光模块接口，时钟资源可以提供最多44组完全独立的通道速率。每个收发器通道均内嵌完整的pma和pcs功能，可以以硬核支持多种速率。它支持高级的通道发送和接收均衡功能包括预加重，自适应线性均衡和dfe。支持通道参数的动态重配置功能，并支持eyeq。stratix v gx系列已经大规模进入量产。
突破带宽：stratix v gx系列可提供多达66个14.1gb/s收发器通道
下图是arria v系列的演示。arria v 是兼顾成本、性能和功耗的中端器件。新推出的arria v gz是最大带宽的中端器件，填补了高端与低端器件之间的空白。它可提供多达36个600mb/s到12.5gb/s的全双工收发器并支持背板传输。它是中端器件唯一可完整支持第三代pci express的。arria v gz支持1600mb/s ddr3接口速率，提供业界最高的中端器件内核性能。
arria v fpga：成本、性能和功耗达到均衡
arria v gz：最大带宽的中端器件
下图是cyclone v开发套件。cyclone v gx/gt fpga系列面向低功耗和低成本应用，基于tsmc 28nm lp低功耗工艺制程。它集成12路3.125 / 5gb/s双工收发器，5gb/s单通道功耗仅88mw，内嵌硬核pcie和ddr3控制器，节省逻辑资源，提高系统性能和开发效率。
该系列采用avalon memory mapped架构，自动生成pcie tlp编/解码逻辑，极大地缩短工程开发时间。pcie接口带宽吞吐效率大于80%。cyclone v gt fpga支持pcie gen2，可将pcie带宽再提升1倍。400mhz ddr3控制器接口灵活支持x8 / x16 / x32bits数据位宽，支持ecc校验。采用avalon streaming接口，总线效率可达90%以上。
cyclone v fpga：pcie / ddr3 dma
下面的是opencl演示。opencl标准是第一个开放编程模型，能够在异构系统上加速算法实现。一个演示展示opencl是怎样加速mandelbrot算法性能的。另一个演示展示opencl怎样为异构计算提供统一的平台：把为gpu编写的nvidia代码移植到stratix v fpga上。
业界首款提供fpga支持opencl开发环境 下图展示的是cyclone v soc开发板，在双核cpu上启动并运行linux。这是altera发售的第一款器件是低功耗、低成本cyclone v soc （fpga+arm）。这个开发板刚刚到货，altera的工程师也是第一次见到。该器件的特点是具有硬核的存储器控制器、灵活的启动功能、以及在全部soc器件集成pci express。altera是目前唯一发售支持32位纠错码（ecc）的soc的fpga供应商，保证了整个嵌入式系统的数据完整性。
前不久，altera和arm联合开发了altera版的arm development studio 5（ds-5）工具包，具有专门支持altera soc器件的fpga自适应调试功能，产品应用包括无线通信、工业、视频监控、汽车和医疗设备等市场。
altera第一款soc器件：cyclone v soc （fpga+arm）
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arria v fpga：成本、性能和功耗达到均衡
arria v gz：最大带宽的中端器件
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