基于STM32的双路信号源及配置平台设计
随着在雷达探测、仪表测量、化学分析等领域研究的不断深入，不仅要求定性的完成目标检测，更加需要往高精度、高分辨率成像的方向发展。一方面，产生频率、幅度灵活可控，尤其是低相位噪声、低杂散的频率源对许多仪器设备起着关键作用。另一方面，电子元器件实际性能参数并非理想以及来存在自外部内部的干扰，大量的误差因素会严重影响系统的准确性。双路参数可调的信号源可有效地对系统误差、信号通道间不平衡进行较调，并且可以产生严格正交或相关的信号，这在弱信号检测中发挥重要作用。为此本文采用双通道dds方法，以stm32为控制器，完成了一种高分辨率灵活可调的双路信号源电路设计。
1 dds原理及系统方案
1.1 dds工作原理
直接数字频率合成(dds)是一种以一个固定频率的精确时钟源为参考，使用数字数据处理模块产生频率和相位可调的输出信号的技术。本质上，dds内部结构是通过可编程的二进制控制字所设置的尺度因子对参考时钟进行“分频”。控制字通常为24-48位长，使dds实现卓越的输出频率分辨率。直接数字频率合成器可以通过精密参考时钟，地址计数器，可编程的只读存储器(prom)和一个d/a转换器来实现，其结构如图1所示。
图1 dds基本结构
通过在数字信号链路上引入相位累加功能，使这种架构成为一个数控振荡器，同时也是高度灵活dds器件的核心。如图2所示，在正弦查找表之前用n-bit可变模的计数器和相位寄存器来替换地址计数器，形成一种具有“相位轮”的dds结构，“相位轮”上的每一点与恰好与正弦波周期波形上的每一点对应。
图2 可变频dds结构与数字相位轮
dds的输出频率为：
其中，fout为输出频率，m为二进制控制字，fc为参考时钟源，n为相位累加器的位宽(决定频率分辨率)。
dds发展趋势是功能集成，在单芯片上增加数模模块实现更广泛的应用。这些模块主要有：
1)可编程的输入时钟倍频模块。
2)可编程幅度，相位控制模块。
3)多波形产生控制模块。
4)各种调制及扫描模块。
1.2 系统方案
整个信号源系统主要由stm32控制器、ad9958、输出电路、滤波电路、外围电路和上位机配置软件等构成。系统框图如图3所示。
图3 系统方案框图
上位机控制软件将需要配置(或读取)的参数以命令的方式发送到控制器，控制器解析命令后完成对芯片的配置或读取相应的参数回发到上位机。系统采用双通道dds器件ad9958为频率发生器，该器件由两个dds内核构成，频率、幅度、相位控制字位宽分别为32bit、10bit、14bit，可满足高分辨率信号需求。每个通道可提供独立的频率、幅度和相位控制，具有卓越的通道隔离度(大于72db)。由于两个通道采用相同系统参考时钟，因此两个通道间具有内在的同步性，通过菊花链连接方式可实现多个器件间同步。ad9958另外一个突出的优点是低功耗，在具有多通道dds器件中，其功耗是最低的。通过外部控制引脚(pwr_dwn_ctl)和内部可配置寄存器fr1[7:6]、cfr[7:6]，实现多种低功耗工作模式。
2 滤波器及ad9958输出电路设计
2.1 lc椭圆低通滤波器的设计
dds数字式的结构特点也带来了输出杂散的问题。杂散的来源有：
1)dac输出非理想。
2)参考时钟。
3)幅度量化误差。
4)相位截断。
相位截断杂散以及与相位—幅度转换过程相关的杂散是dds设计中的有限相位和幅度分辨率造成的结果，对于高性能dds可以忽略，因而杂散的主要来源是dac非理想和参考时钟。其中dac输出功率与量化噪声比可用下式计算：
式中sqr为信噪比，b为dac分辨率位宽，ffs为dac输出满量程分数(常见值为1/2,1/4,1/8/,1/16)。
在时钟为300mhz，输出为80mhz时，dac采样输出幅度谱如图4所示。
图4 采样输出谱分析
对ad9958器件模型进行仿真分析，在无输出滤波器条件下得到的仿真结果如图5所示。
图5 直接输出频谱及时域波形
图中ppt表示相位截断杂散，dac images表示输出镜像频率造成的杂散，dh2、dh3分别是二、三次谐波引起杂散，可见杂散分量主要由镜像频率分量引起。杂散数据表如表1所示。
从数据表中可知相位截断(ppt)杂散为(-70.017dbc)，可以忽略。在dac输出插入低通滤波器后，ad9958输出会明显改善，输出谱及波形如图6所示。
图6 滤波后输出频谱及时域波形
根据ad9958性能参数，所需设计的低通滤波器指标如下：
类型：椭圆lc滤波器
通带截止频率：fc=200mhz
通带纹波：ε=0.3
阻带及衰减fs=230mhz，50db
输入输出匹配阻抗：100ω
最终设计出的滤波器结构参数及仿真结果如图7(a)、(b)所示。
图7(a) 7阶椭圆低通滤波器结构及参数
图7(b) 7阶椭圆低通滤波器幅频响应
2.2 信号源输出电路
由于ad9958频率输出是一个电流型输出，等效模型为内阻为100kω的电流源。dac输出电流的满量程值由外部电阻rset决定，计算公式如下：
而需要设计的信号源是电压型输出并能提供一定的输出驱动能力，所以需要对adc输出进行转换，并在滤波器后插入缓冲放大器。若采用中心抽头变压器进行电流电压变换，在低频时会造成插入损耗过大，固直接通过终端电阻来转换。输出驱动放大器采用高速放大器ada4891-2。
ada4891是一款cmos、高速、高性能、低成本放大器，具有单电源供电，输入电压范围可扩展至负电源轨300mv以下，轨到轨输出级使输出摆幅可以达到各供电轨50mv以内，以提供最大的动态范围，线性输出电流150ma(-50dbc时)，-3db带宽为240mhz，功耗仅为4.4ma。最终设计的输出电路如图8所示。
图8 ad9958输出转换及驱动电路
3 配置平台设计
配置平台主要由控制器和上位机软件构建，二者之间通过配置接口实现命令数据交互，完成dds的配置、控制，参数读取。控制器选用stm32f107，上位机软件以vc6.0为平台来设计，通过串口控件mscomm实现通信。stm32f107是以cortex-m3为内核的一款32位处理器，采用该器件主要是基于以下几点原因：
1)接口丰富，带usart，spi(sck时钟可达36mhz，单线双线模式)。
2)含内部flash，可以将配置数据保存，无需外加非易失存储器。
3)性能优异，功耗低。
控制器软件流程图如图9所示。
图9 stm32f107控制软件流程图
上位机软件提供一个良好的可视化界面，通过获取用户指定有效参数(无效则给出错误报告)，完成下发命令、接收数据、处理下位机回发报告等任务。设计的软件界面如图10所示。
图10 上位机平台界面
用户可通过界面完成一些常用的配置或直接对指定的ad9958寄存器进行读写，还可以将配置存入flash，以便控制器下次启动后可直接恢复输出。向ad9958内部地址0x04(cftw0寄存器写)入0x01a80022配置的spi帧格式(msb first)如图11所示。
图11 写0x04寄存器的spi帧格式
4 结语
结果表明信号源输出特性良好，还具有集成的高、功耗低、配置灵活等优点。为了满足不同应
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图1 dds基本结构
通过在数字信号链路上引入相位累加功能，使这种架构成为一个数控振荡器，同时也是高度灵活dds器件的核心。如图2所示，在正弦查找表之前用n-bit可变模的计数器和相位寄存器来替换地址计数器，形成一种具有“相位轮”的dds结构，“相位轮”上的每一点与恰好与正弦波周期波形上的每一点对应。
图2 可变频dds结构与数字相位轮
dds的输出频率为：
其中，fout为输出频率，m为二进制控制字，fc为参考时钟源，n为相位累加器的位宽(决定频率分辨率)。
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1)可编程的输入时钟倍频模块。
2)可编程幅度，相位控制模块。
3)多波形产生控制模块。
4)各种调制及扫描模块。
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图3 系统方案框图
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图4 采样输出谱分析
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