富士通拟设计2纳米芯片 委托台积电代工
据日经新闻报道，富士通cto 昨日宣布，富士通将自行设计2纳米芯片，计划委托给台积电代工，目标是2026年将此产品应用在节能cpu中。
此前消息，台积电在今年6月份正式公布2nm工艺，并透露了一些技术细节，相比3nm工艺，在相同功耗下，2nm速度快10~15%；相同速度下，功耗降低25~30%。台积电ceo魏哲家表示，2nm工艺的进展很顺利，甚至超过预期，不过他们现在的计划依然是2025年量产，没打算提前。
英特尔在2022年第三季度财报披露了其制程工艺的最新进展，称intel 20a和18a第一批内部测试芯片已流片，正在为一家主要的潜在代工客户在晶圆厂中进行内部测试芯片的生产，而intel 20a工艺大致处于业界2nm的水平。
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