测试平台的建立方法
（1）dut模型的建立
•① 164245模型：在modelsim工具下用verilog hdl语言［5］，建立164245模型。164245是一个双8位双向电平转换器，有4个输入控制端：1dir，1oe，2dir，2oe；4组8位双向端口：1a，1b，2a，2b。端口列表如下：
input dir_1，dir_2，oe_1，oe_2；inout ［0：7］ a_1，a_2，b_1，b_2；reg ［0：7］
bfa1，bfb1，bfa2，bfb2；//缓冲区
•② 缓冲器模型：建立一个8位缓冲器模型，用来做test bench 与164245 之间的数据缓冲``
（2）test bench的建立
依据器件功能，建立test bench平台，用来输入仿真向量。 test bench中变量定义：
reg dir1，dir2，oe1，oe2； //输入控制端
reg［0：7］ a1，a2，b1，b2； //数据端
reg［0：7］ a1_out［0：7］； //存储器，用来存储数据
reg［0：7］ a2_out［0：7］；reg［0：7］ b1_out［0：7］；reg［0：7］ b2_out［0：7］；
通过test
图6 test bench验证平台框图
（3）仿真和验证
通过test bench 给予相应的测试激励进行仿真，得到预期的结果，实现了器件功能仿真，并获得了测试图形。图7和图8为部分仿真结果。
图7 仿真数据结果
在jc-3165的*.mdc图形文件中，对输入引脚，用“1”和“0”表示高低电平；对输出引脚，用“h”和“l”表示高低电平；“x”则表示不关心状态。
由于在仿真时，输出也是“0”和“1”，因此在验证结果正确后，对输出结果进行了处理，分别将“0”和“1”转换为“l”和“h”，然后放到存储其中，最后生成*.mdc图形文件。
图8 生成的*.mdc文件
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bfa1，bfb1，bfa2，bfb2；//缓冲区
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（2）test bench的建立
依据器件功能，建立test bench平台，用来输入仿真向量。 test bench中变量定义：
reg dir1，dir2，oe1，oe2； //输入控制端
reg［0：7］ a1，a2，b1，b2； //数据端
reg［0：7］ a1_out［0：7］； //存储器，用来存储数据
reg［0：7］ a2_out［0：7］；reg［0：7］ b1_out［0：7］；reg［0：7］ b2_out［0：7］；
通过test
图6 test bench验证平台框图
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通过test bench 给予相应的测试激励进行仿真，得到预期的结果，实现了器件功能仿真，并获得了测试图形。图7和图8为部分仿真结果。
图7 仿真数据结果
在jc-3165的*.mdc图形文件中，对输入引脚，用“1”和“0”表示高低电平；对输出引脚，用“h”和“l”表示高低电平；“x”则表示不关心状态。
由于在仿真时，输出也是“0”和“1”，因此在验证结果正确后，对输出结果进行了处理，分别将“0”和“1”转换为“l”和“h”，然后放到存储其中，最后生成*.mdc图形文件。
图8 生成的*.mdc文件
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