主从触发器(master-slave flip-flop)基

图13-11(a)所示为主从rs触发器原理电路。它是由两个高电平触发方式的同步rs触发器构成。其中门e、f、g、h构成主触发器,时钟信号为cp,输出为q、,输入为r、s。门a、b、c、d构成从触发器,时钟信号为,输入为主触发器的输出、主q,输出为q、。从触发器的输出为整个主从触发器的输出,主触发器的输入为整个主从触发器的激励输入。
当cp=0时,=1。主触发器被封锁;而从触发器被打开,接收主触发器的内容,
从而使主
当cp=1时,此时主触发器接收输入激励信号,其状态方程为
此时,因为=0,从触发器被封锁,输出端q、保持原来状态不变。
当cp由1跳变至0时,因为cp=0,主触发器维持状态不变。而由0跳变至1,从触发器接收cp=1期间存入主触发器的信号,从而更新状态,状态方程为
综上所述,图13-11(a)所示的主从触发器的工作分两步进行。第一步,当cp由0跳变到1及cp=1期间,主触发器接收输入信号激励,状态发生变化;而由1变为0,=0,从触发器被封锁,因此,触发器状态保持不变,这一步称为准备阶段。第二步是当cp由1跳变到0,且cp=0期间,主触发器被封锁,状态保持不变;而从触发器时钟由0跳变到1,接收这一时刻主触发器的状态,触发器输出状态发生变化。
在cp的一个变化周期内,只有在cp下降沿来到的瞬间,触发器输出状态(q、)才能发生一次翻转,这种触发方式称为脉冲触发。因此,这种触发器能有效地克服空翻。图13-12所示为主从rs触发器的工作波形。在图13-11(b)中cp端的小圆圈“〇”表示触发器是cp下降沿触发的。

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主从触发器(master-slave flip-flop)基
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