UVM Transaction-Level验证组件
如下图所示，uvm中的tlm接口为组件之间transaction的发送和接收提供了一套统一的通信方法。
一个简单的transaction-level 验证环境的基本组成部分是：
一个激励发生器（sequencer），用于创建 transaction-level激励到dut。
一个driver将这些transactions转换为dut接口的信号级激励。
一个monitor来识别dut接口上的信号级行为，并将其转换为transactions。
一个analysis component，如coverage collector或scoreboard，以“分析”transactions。
正如我们看到的，uvm中tlm接口使得验证组件可以非常轻松地复用，而不考虑其内部实现。
上图中各个验证组件进一步组合成验证组件agent。uvm agent是一个封装了sequencer，driver和monitor的验证组件，它实例化这些组件并通过tlm接口连接。由于uvm的可配置性，agent还可以具有配置选项，例如uvm 的类型（主动/被动），是否打开功能覆盖率收集等功能的旋钮以及其他类似参数。
验证环境开发者不是单独复用这些low-level的验证组件，而是复用整个agent，更容易形成一致的架构，更容易学习、 使用和配置。
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