MIMXRT1060 FLEXIO SPI速率
flexio 支持 1/2/4/8/16/32位并行传输，参考寄存器 shiftcft[pwidth]进行设置。
flexio1 和 flexio2/3 参数不是完全相同，flexio1有16个引脚，而 flexio2/3 有 32个引脚。在i.mx rt1060用户手册中，dma mux映射没有flexio3，只有flexio1和flexio2。dma外设无法访问flexio3模块，因此，如果需要dma功能，只能使用flexio1和flexio2。
为此 sdk提供了 flexio和 flexio3的例程。
如果没有可用的 flexio实现spi，可以使用硬件的 lpspi接口，支持dma，可以降低cpu运行的负荷。lpspi的时钟 fsck速率只有 15mhz。
flexio 不能在同一周期内移动和存储。例如当尝试使用 flexio实现spi从设备时，将发现它无法在同一周期内移动和存储。时钟的下降沿不用于锁存最后的数据位。一种解决方法是使用其他定时器计数数字位并产生禁用信号。然而，它有两个限制：1）需要知道传输速率，并设置此定时器具有相同的波特率。2） 它需要传输是异步的，没有任何时钟拉伸；否则，将导致失败。因此，从器件接收不是同步的。
使用示波器测量spi信号，miso 接收和mosi 发送数据，但在dma缓冲区中，数据向右移动了1位。flexio接口模拟具有dma的spi通信，将cpha配置为1，在第二边缘采样（在下降边缘锁定）。flexio源时钟clk选择120mhz，flexio_spi clk设置为20mhz，数据在下降沿采样。
masterconfig->enablemaster =true;
masterconfig->enableindoze =false;
masterconfig->enableindebug =true;
masterconfig->baudrate_bps =20000000u;
masterconfig->phase =kflexio_spi_clockphasesecondedge;
masterconfig->datamode =kflexio_spi_8bitmode;
备注：如设置大于20mhz 时钟频率，主机端实际接收数据一个字节总是被接收/存储两次。
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masterconfig->enableindoze =false;
masterconfig->enableindebug =true;
masterconfig->baudrate_bps =20000000u;
masterconfig->phase =kflexio_spi_clockphasesecondedge;
masterconfig->datamode =kflexio_spi_8bitmode;
备注：如设置大于20mhz 时钟频率，主机端实际接收数据一个字节总是被接收/存储两次。
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