硬件电路的理论分析
背景
这几天研究的产品的核心算法是发射和接收的正弦信号的相位差检测。
在stm32f407处理器上，通过dma+spi通信对接收和发射信号进行高速采样。
设计算法计算接收和发射信号的相位差。
用delphi改了一个简单的调试用的上位机软件。
下位机通过串口将采集到的a/d值以及计算结果发送给上位机。
上位机将数据以图形界面显示出来，同时对计算结果进行统计分析，判断算法的正确性，
并根据分析结果调整参数。
花了两个晚上的时间，完成了上位机和下位机的算法设计、代码编写和调试。
用于产品调试的上位机软件界面
电路分析
今天晚上开始分析测试结果。
第一步是和硬件电路的理论分析进行比较。
客户设计的电路
输入信号的频率为4khz-18khz。
在该电路中，
c1、c2的阻抗为：
跟与其串联的电阻r4相比，可以忽略不计。
同理，电容c8的阻抗为
，跟r9相比，也可以忽略不计。
+3.3v通过r1、r3的分压得到1.65v给轨对轨运放ada4841提供直流工作电平，使其可以通过单电源供电。
综合考虑之后，可以得到该电路的交流通路，如下图：
电路交流通路
相位分析
电阻r4，电容c6构成高通滤波器，
传递函数为：
幅值函数为：
-3db截止截止频率为
幅频特性曲线
相角函数为：
相频特性
当频率为18khz时，运放同相输入端的电压相对于输入电压的相位超前，
幅度比值为1。
r9、r10、c7构成低通滤波器，从运放同相端到输出端的传递函数为：
幅频特性曲线
相频特性曲线
当频率为18khz时，运放输出端的电压相对于同相输入端电压的相位滞后，幅度比值为16.25。
因此，当频率为18khz时，运放输出端与输入信号的相位滞后。
ad4020差分输入信号vout+-vout-与运放输出的差分信号v1+-v1-在频率域满足以下关系式：
当频率为18khz时，ad4020输入信号与运放输出信号相比相位滞后，幅度比值为0.81。
综上，处理电路导致相位滞后为。
multisum仿真
multisum仿真与计算结果一致。
原文标题：用于相位差检测的处理电路理论计算分析
文章出处：【微信公众号：硬件攻城狮】欢迎添加关注！文章转载请注明出处。
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上位机将数据以图形界面显示出来，同时对计算结果进行统计分析，判断算法的正确性，
并根据分析结果调整参数。
花了两个晚上的时间，完成了上位机和下位机的算法设计、代码编写和调试。
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客户设计的电路
输入信号的频率为4khz-18khz。
在该电路中，
c1、c2的阻抗为：
跟与其串联的电阻r4相比，可以忽略不计。
同理，电容c8的阻抗为
，跟r9相比，也可以忽略不计。
+3.3v通过r1、r3的分压得到1.65v给轨对轨运放ada4841提供直流工作电平，使其可以通过单电源供电。
综合考虑之后，可以得到该电路的交流通路，如下图：
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传递函数为：
幅值函数为：
-3db截止截止频率为
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相频特性
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幅度比值为1。
r9、r10、c7构成低通滤波器，从运放同相端到输出端的传递函数为：
幅频特性曲线
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当频率为18khz时，运放输出端的电压相对于同相输入端电压的相位滞后，幅度比值为16.25。
因此，当频率为18khz时，运放输出端与输入信号的相位滞后。
ad4020差分输入信号vout+-vout-与运放输出的差分信号v1+-v1-在频率域满足以下关系式：
当频率为18khz时，ad4020输入信号与运放输出信号相比相位滞后，幅度比值为0.81。
综上，处理电路导致相位滞后为。
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