一文详解主从触发器
触发器
利用一个称为“时钟”的特殊定时控制信号去限制存储单元状态的改变时间,具有这种特点的存储单元电路称为触发器。
主从触发器
1. 主从rs 触发器
(1)主从 rs 触发器的电路结构
(2)主从 rs 触发器的工作原理
1)在cp=0时,主锁存器f1的控制门打开,处于工作状态,主锁存器按s、r的值改变中间状态qm;从锁存器f2的控制门关闭,处于保持状态;
2) 在cp=1时,主锁存器f1的控制门关闭,进入保持状态;从锁存器f2的控制门打开,处于工作状态,电路根据qm的状态改变输出状态;
主从 rs 触发器的电路特点：
1)clk脉冲不论在低电平或高电平期间,电路的输出状态最多只改变一次;(常把控制信号有效期间,输出状态发生多次变化的现象称为空翻)
2) 将主从rs触发器用于时序电路中,不会因不稳定而产生振荡.
主从 rs 触发器的电路符号：
(3)主从 rs 触发器的逻辑功能描述
1)主从rs触发器的特性表
主从rs触发器的特性表和特性方程和rs锁存器基本相同,只是在列特性表时,要加上cp脉冲标志.
2)主从rs触发器的特性方程
3) 主从rs 触发器的定时波形
2. 主从d 触发器
工作原理:
(1) 当cp=0时,主锁存器被选通,qm=d, 从锁存器保持原态;
(2) 当cp=1时,主锁存器保持原态, 从锁存器被选通,q=qm;
特性方程:q^n+1=d
定时波形图
3. 主从jk 触发器
为去除主从rs触发器的约束条件:rs=0,设计出主从jk触发器.
(1)主从jk触发器的一种结构和逻辑符号
(2)主从jk触发器的特点
1) 电路以d触发器为核心,故不存在约束条件;
3) 由电路可见,cp是经一个非门送入d触发器,所以这种结构的jk触发器为cp下降沿到达时改变状态.
(4) 状态图
(5) 带异步清零、置1端并具有多驱动输入的jk触发器。
(6) 主从jk触发器定时波形
4. 主从触发器的缺陷
主从触发器抗干扰能力不强
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1)clk脉冲不论在低电平或高电平期间,电路的输出状态最多只改变一次;(常把控制信号有效期间,输出状态发生多次变化的现象称为空翻)
2) 将主从rs触发器用于时序电路中,不会因不稳定而产生振荡.
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3) 由电路可见,cp是经一个非门送入d触发器,所以这种结构的jk触发器为cp下降沿到达时改变状态.
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