高通微软又有新合作？
据悉，微软已经将windows 10与linux双系统移植到了基于edge体系结构的e2芯片上。微软自2010年开始，便致力于进行edge架构处理器的研发。
除了双系统，这颗芯片还移植了busybox与freertos，标准c/c++与.net core运行时库，windows内核调试器，visual c++ 2017命令行工具以及.net即时编译器ryujit。
微软还将广泛使用的llvm c/c++编译器、调试器以及相关的c/c++运行时库，移植到了e2上。微软研发团队希望证明一件事情，即“改变”这颗芯片不需要重新为它编写软件，而是只通过重新编译程序即可。
据悉，e2处理器的原型是具有可编程能力的fpga，这是芯片开发期间通常采用的形式。微软团队开发了一个能够启动windows和linux系统，并可以运行应用程序的周期精确模拟器。
显然，微软e2的设计思想与arm、amd等公司大相径庭，它采用edge（explicit data graph execution）体系结构。据悉，高通研发人员正在评估两款基于edge架构的芯片设计：较小的r0内核，以及运行频率2ghz、10nm工艺的r1。目前该项目仍在进行中。
如今市面上典型主流处理器的运行规则更像是一个“垃圾回收机”：垃圾通过一条仅有的传送带依次进入垃圾回收机，随后机器根据垃圾的类别进行分类，再送到不同的传送带进行独立传输，并最终由机器的不同部分进行处理。以arm cortex-a76为例，其指令被分到八个传送带送进内核进行传输：四路用于整数运算，两路用于浮点运算，两路用于访问存储器中的数据。即使最前端接收到的是无序的执行指令，处理器也将有条不紊地进行指令的处理。
对于研发人员而言，他们想做的就是：避免资源浪费。举例而言，尽管一个整数单元不进行任何运算，然而其他路指令的执行却要进行排队。如果一条通道的指令执行需要依赖于另外一条通道的指令执行输出，就需停下来等待，这样时间与资源就被浪费掉。处理器要每秒运行10亿次及以上，就为了保证工作的完成。
也许e2所采用的edge架构能有效解决以上问题。edge是一种分布式结构，指令映射到多个分片上同时执行。在不同的代码分片中，代码使用其专用寄存器，而非全局访问的执行模式。编译器还会对代码进行注释以描述数据在程序中的流向，从而允许cpu相应地调度指令块。
而且，edge可以让核心处理器通过分片技术同时处理多个指令。这与cortex-a76的运行方式是不同的。edge的目标就是比竞争对手的架构可以更快地运行软件。就像前面提到的高通r1设计一样。 r1是32位指令宽的乱序处理器蓝图，r0是8位宽。
e2芯片的研发已进行多年，透过目前的消息来“窥见”e2的研发进展。
去年10月份，linux系统在e2中启动，如今windows 10已经被移植到该架构中，同时微软正在与芯片巨头高通开展合作。不过微软官网上周删除了e2项目的相关页面及最新信息。
在今年美国加州举办的计算机体系结构国际会议上，微软研究员doug burger、aaron smith、greg wright与高通处理器研究部门的高级工程主管，都发表了关于edge处理器的演讲，并演示了windows在e2模拟器上的运行情况。
尽管e2的指令部署已经在几年前完成，但是现在大部分信息仍作为机密不对外公开。目前来看，外界可得知的消息就是每个代码块都会从全局寄存器读取数据，并在临时专用寄存器进行数据的处理，最终将结果写回全局寄存器。
微软在设计芯片方面已经有了一定的案例，例如hololens虚拟现实护目镜中的数学加速器。 据推测，这种e2架构设计可能最适合在fpga中实现“软”处理器。
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据悉，e2处理器的原型是具有可编程能力的fpga，这是芯片开发期间通常采用的形式。微软团队开发了一个能够启动windows和linux系统，并可以运行应用程序的周期精确模拟器。
显然，微软e2的设计思想与arm、amd等公司大相径庭，它采用edge（explicit data graph execution）体系结构。据悉，高通研发人员正在评估两款基于edge架构的芯片设计：较小的r0内核，以及运行频率2ghz、10nm工艺的r1。目前该项目仍在进行中。
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对于研发人员而言，他们想做的就是：避免资源浪费。举例而言，尽管一个整数单元不进行任何运算，然而其他路指令的执行却要进行排队。如果一条通道的指令执行需要依赖于另外一条通道的指令执行输出，就需停下来等待，这样时间与资源就被浪费掉。处理器要每秒运行10亿次及以上，就为了保证工作的完成。
也许e2所采用的edge架构能有效解决以上问题。edge是一种分布式结构，指令映射到多个分片上同时执行。在不同的代码分片中，代码使用其专用寄存器，而非全局访问的执行模式。编译器还会对代码进行注释以描述数据在程序中的流向，从而允许cpu相应地调度指令块。
而且，edge可以让核心处理器通过分片技术同时处理多个指令。这与cortex-a76的运行方式是不同的。edge的目标就是比竞争对手的架构可以更快地运行软件。就像前面提到的高通r1设计一样。 r1是32位指令宽的乱序处理器蓝图，r0是8位宽。
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尽管e2的指令部署已经在几年前完成，但是现在大部分信息仍作为机密不对外公开。目前来看，外界可得知的消息就是每个代码块都会从全局寄存器读取数据，并在临时专用寄存器进行数据的处理，最终将结果写回全局寄存器。
微软在设计芯片方面已经有了一定的案例，例如hololens虚拟现实护目镜中的数学加速器。 据推测，这种e2架构设计可能最适合在fpga中实现“软”处理器。
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