Tensilica 处理器在90纳米工艺速度500MHz
tensilica(泰思立达)公司宣布，意法半导体公司(st)采用tensilica的xtensa v可配置处理器内核的芯片在90纳米的工艺下的第一次流片的成功证明了tensilica公司的这款可配置处理器内核可以达到500 mhz的时钟速率。意法半导体公司即将在几个月后进行第2次设计流片，该设计将使用tensilica公司的xtensa lx处理器内核，在90纳米的工艺下其仿真速度最快将可以达到700mhz。因此，tensilica公司的xtensa lx处理器内核也将成为业界最快、可综合，且可配置的处理器内核。
st公司配置tensilica的xtensa v处理器内核将用于典型的网络多核应用，并利用专门的32k-byte cache设计和先进的物理综合技术在90纳米的工艺下进行优化。其流片出来的芯片在0.9v电压下操作频率可以达到500mhz，同时保证了相当低的功耗，只有0.16mw/mhz.
这些结果使tensilica的xtensa lx和xtensa v处理器内核无论是在传统的cpu控制中应用，还是用于高速应用的加速--例如作为rtl(寄存器传输级)模块设计的替代选择，都具有无可比拟的吸引力。tensilica的xtensa可配置处理器内核除了作为完全可编程的32位处理器以外，还可以使整个系统的设计更快，它能够自动验证，并且它的结构保证了其正确性。设计者可以在tensilica公司的xpres编译器上运行已有的c/c++算法来自动的在一个小时内对xtensa lx处理器内核进行定制，而一个典型的rtl的设计周期一般需要6-9个月的设计投入。
st公司90纳米的设计平台是针对片上系统(soc)和asic在无线、消费电子及网络应用的解决方案。它的特色包括：高达9层的金属的铜互连，低k电介系数，双闸氧化以及dual-vt晶体管。其标准单元库含有1000多个门单元，门延迟为11ps，库密度每平方毫米超过400,000个门。
“我们许多的asic客户将tensilica的xtensa 处理器内核看作是能够增加其设计灵活性的选择，特别是在他们要在90纳米的工艺上投资时，”意法半导体公司wli部门asic bu总监flavio benetti说，“这些处理器内核显示出来的如此高的时钟速率和可扩展性使他们成为替代rtl设计的极具吸引力的方式，特别是它们可以很快的被修改以满足特殊的应用的需求。”
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